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54套数字/模拟IC设计视频课程455G网盘资源合集，包含数字IC系统验证/前端设计/后端PR/模拟版图设计/模拟IC电路设计/DFT/UVM/SOC…等
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数字IC资料大全（524G） [ 527.14GB ]
｜ ｜ 酒酒资料总结.zip [ 3.22GB ]
｜ ｜ 数字IC笔试面试题集合.rar [ 26.34MB ]
｜ ｜ FPGA资料（全） [ 182.50GB ]
｜ ｜ ｜ 27个FPGA实例源代码 [ 2.25MB ]
｜ ｜ ｜ ｜ 8.10 FSK调制与解调VHDL程序及仿真.doc [ 85.50kB ]
｜ ｜ ｜ ｜ 8.11 PSK调制与解调VHDL程序及仿真.doc [ 113.00kB ]
｜ ｜ ｜ ｜ 8.12 MASK调制VHDL程序及仿真.doc [ 59.50kB ]
｜ ｜ ｜ ｜ 8.13 MFSK调制VHDL程序及仿真.doc [ 90.00kB ]
｜ ｜ ｜ ｜ 8.14 MPSK调制与解调VHDL程序与仿真.doc [ 123.00kB ]
｜ ｜ ｜ ｜ 8.15 基带码发生器程序设计与仿真.doc [ 78.00kB ]
｜ ｜ ｜ ｜ 8.16 频率计程序设计与仿真.doc [ 146.50kB ]
｜ ｜ ｜ ｜ 8.17 采用等精度测频原理的频率计程序与仿真.doc [ 172.00kB ]
｜ ｜ ｜ ｜ 8.18 电子琴程序设计与仿真 2004.8修改.doc [ 106.50kB ]
｜ ｜ ｜ ｜ 8.18 电子琴程序设计与仿真.doc [ 105.50kB ]
｜ ｜ ｜ ｜ 8.19 电梯控制器程序设计与仿真.doc [ 252.00kB ]
｜ ｜ ｜ ｜ 8.2 LED控制VHDL程序与仿真 2004.8修改.doc [ 33.50kB ]
｜ ｜ ｜ ｜ 8.2 LED控制VHDL程序与仿真.doc [ 33.50kB ]
｜ ｜ ｜ ｜ 8.20 电子时钟VHDL程序与仿真.doc [ 115.00kB ]
｜ ｜ ｜ ｜ 8.21 自动售货机VHDL程序与仿真.doc [ 199.50kB ]
｜ ｜ ｜ ｜ 8.22 出租车计价器VHDL程序与仿真 2004.8修改.doc [ 59.50kB ]
｜ ｜ ｜ ｜ 8.22 出租车计价器VHDL程序与仿真.doc [ 138.00kB ]
｜ ｜ ｜ ｜ 8.23 波形发生程序.doc [ 60.50kB ]
｜ ｜ ｜ ｜ 8.24 步进电机定位控制系统VHDL程序与仿真.doc [ 30.50kB ]
｜ ｜ ｜ ｜ 8.3 LCD控制VHDL程序与仿真 2004.8修改.doc [ 32.00kB ]
｜ ｜ ｜ ｜ 8.3 LCD控制VHDL程序与仿真.doc [ 26.00kB ]
｜ ｜ ｜ ｜ 8.4 ADC0809 VHDL控制程序.doc [ 24.00kB ]
｜ ｜ ｜ ｜ 8.5 TLC5510 VHDL控制程序.doc [ 21.00kB ]
｜ ｜ ｜ ｜ 8.6 DAC0832 接口电路程序.doc [ 21.00kB ]
｜ ｜ ｜ ｜ 8.7 TLC7524接口电路程序.doc [ 23.00kB ]
｜ ｜ ｜ ｜ 8.8 URAT VHDL程序与仿真.doc [ 86.00kB ]
｜ ｜ ｜ ｜ 8.9 ASK调制与解调VHDL程序及仿真.doc [ 67.00kB ]
｜ ｜ ｜ FPGA CPLD开发学习资料 解压密码 fpga0808mima [ 8.47GB ]
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｜ ｜ ｜ fpgapdf [ 263.68MB ]
｜ ｜ ｜ ｜ Altera FPGA／CPLD设计 高级篇(第2版）.pdf [ 45.02MB ]
｜ ｜ ｜ ｜ Altera FPGA／CPLD设计 基础篇(第2版）.pdf [ 38.56MB ]
｜ ｜ ｜ ｜ Verilog数字系统设计教程-夏宇闻.pdf [ 43.78MB ]
｜ ｜ ｜ ｜ 高级FPGA设计结构、实现和优化.pdf [ 39.37MB ]
｜ ｜ ｜ ｜ 开拓者FPGA开发指南_V1.1.pdf [ 44.66MB ]
｜ ｜ ｜ ｜ 设计与验证：Verilog HDL(清晰带书签).pdf [ 14.41MB ]
｜ ｜ ｜ ｜ 数字电子技术基础 阎石五版.rar [ 10.69MB ]
｜ ｜ ｜ ｜ 数字电子技术基础课本(阎石.第五版).pdf [ 27.19MB ]
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｜ ｜ ｜ FPGA课程 100多个案例免费学 [ 4.31GB ]
｜ ｜ ｜ ｜ 00_00课程介绍.avi [ 48.96MB ]
｜ ｜ ｜ ｜ 第01章 软件介绍及安装 [ 36.54MB ]
｜ ｜ ｜ ｜ ｜ 01_01Questasim软件安装.wmv [ 13.53MB ]
｜ ｜ ｜ ｜ ｜ 01_02QuartusII软件安装.wmv [ 15.58MB ]
｜ ｜ ｜ ｜ ｜ 01_03GVIM安装及使用.wmv [ 7.44MB ]
｜ ｜ ｜ ｜ 第03章 Quartus II技巧 [ 29.46MB ]
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｜ ｜ ｜ ｜ ｜ 03_02Quartus使用练习1说明.wmv [ 4.76MB ]
｜ ｜ ｜ ｜ ｜ 03_03QuartusⅡ使用练习1答案.wmv [ 17.13MB ]
｜ ｜ ｜ ｜ 第04章 入门基础 [ 125.26MB ]
｜ ｜ ｜ ｜ ｜ 04_01verilog代码详细讲解.wmv [ 32.07MB ]
｜ ｜ ｜ ｜ ｜ 04_02入门练习1说明.wmv [ 4.84MB ]
｜ ｜ ｜ ｜ ｜ 04_03入门练习1答案.wmv [ 10.37MB ]
｜ ｜ ｜ ｜ ｜ 04_04入门练习2说明.wmv [ 5.73MB ]
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｜ ｜ ｜ ｜ ｜ 04_07入门练习3答案.wmv [ 20.92MB ]
｜ ｜ ｜ ｜ ｜ 04_08入门练习4说明.wmv [ 6.09MB ]
｜ ｜ ｜ ｜ ｜ 04_09入门练习4答案.wmv [ 23.22MB ]
｜ ｜ ｜ ｜ 第05章 modelsim技巧 [ 197.66MB ]
｜ ｜ ｜ ｜ ｜ 05_01modelsim用法.wmv [ 10.83MB ]
｜ ｜ ｜ ｜ ｜ 05_02modelsim波形观看方法.wmv [ 13.39MB ]
｜ ｜ ｜ ｜ ｜ 05_03modelsim初级练习1说明.wmv [ 8.20MB ]
｜ ｜ ｜ ｜ ｜ 05_04modelsim初级练习1答案.wmv [ 67.57MB ]
｜ ｜ ｜ ｜ ｜ 05_05modelsim初级练习2说明.wmv [ 6.28MB ]
｜ ｜ ｜ ｜ ｜ 05_06modelsim初级练习2答案.wmv [ 29.53MB ]
｜ ｜ ｜ ｜ ｜ 05_07modelsim初级练习3说明.wmv [ 6.16MB ]
｜ ｜ ｜ ｜ ｜ 05_08modelsim初级练习3答案.wmv [ 17.56MB ]
｜ ｜ ｜ ｜ ｜ 05_09modelsim一级练习1说明.wmv [ 5.68MB ]
｜ ｜ ｜ ｜ ｜ 05_10modelsim一级练习1答案.wmv [ 10.65MB ]
｜ ｜ ｜ ｜ ｜ 05_11modelsim一级练习2说明.wmv [ 11.31MB ]
｜ ｜ ｜ ｜ ｜ 05_12modelsim一级练习2答案.wmv [ 10.50MB ]
｜ ｜ ｜ ｜ 第06章 verilog快速掌握 [ 327.71MB ]
｜ ｜ ｜ ｜ ｜ 06_01verilog快速掌握-程序设计.wmv [ 96.81MB ]
｜ ｜ ｜ ｜ ｜ 06_02verilog快速掌握之模块例化.wmv [ 15.27MB ]
｜ ｜ ｜ ｜ ｜ 06_03verilog快速掌握之运算符.wmv [ 38.40MB ]
｜ ｜ ｜ ｜ ｜ 06_04verilog快速掌握之模块设计说明.wmv [ 6.54MB ]
｜ ｜ ｜ ｜ ｜ 06_05verilog快速掌握之模块设计答案.wmv [ 47.62MB ]
｜ ｜ ｜ ｜ ｜ 06_06verilog快速掌握之复杂模块设计说明.wmv [ 8.80MB ]
｜ ｜ ｜ ｜ ｜ 06_07verilog快速掌握之复杂模块设计答案.wmv [ 74.70MB ]
｜ ｜ ｜ ｜ ｜ 06_09verilog快速掌握练习1说明.wmv [ 5.16MB ]
｜ ｜ ｜ ｜ ｜ 06_10verilog快速掌握练习2说明.wmv [ 5.16MB ]
｜ ｜ ｜ ｜ ｜ 06_11verilog快速掌握练习3说明.wmv [ 5.16MB ]
｜ ｜ ｜ ｜ ｜ 06_12verilog快速掌握练习4说明.wmv [ 8.79MB ]
｜ ｜ ｜ ｜ ｜ 06_13verilog快速掌握练习5说明.wmv [ 10.50MB ]
｜ ｜ ｜ ｜ ｜ 06_14模块设计模板.wmv [ 4.79MB ]
｜ ｜ ｜ ｜ 第07章 测试文件 [ 438.80MB ]
｜ ｜ ｜ ｜ ｜ 07_01测试文件编写技巧.wmv [ 7.81MB ]
｜ ｜ ｜ ｜ ｜ 07_02测试文件模板.wmv [ 22.83MB ]
｜ ｜ ｜ ｜ ｜ 07_03测试文件编写练习1说明.wmv [ 13.11MB ]
｜ ｜ ｜ ｜ ｜ 07_04测试文件编写练习1答案.wmv [ 54.24MB ]
｜ ｜ ｜ ｜ ｜ 07_05包文的概念.wmv [ 30.74MB ]
｜ ｜ ｜ ｜ ｜ 07_06测试文件编写练习2说明.wmv [ 65.39MB ]
｜ ｜ ｜ ｜ ｜ 07_07测试文件编写练习2答案.wmv [ 78.34MB ]
｜ ｜ ｜ ｜ ｜ 07_08测试文件编写练习3说明.wmv [ 19.73MB ]
｜ ｜ ｜ ｜ ｜ 07_09测试文件编写练习3答案.wmv [ 42.39MB ]
｜ ｜ ｜ ｜ ｜ 07_10测试文件编写练习4说明.wmv [ 19.46MB ]
｜ ｜ ｜ ｜ ｜ 07_11测试文件编写练习4答案.wmv [ 22.47MB ]
｜ ｜ ｜ ｜ ｜ 07_12测试文件编写练习5说明.wmv [ 14.26MB ]
｜ ｜ ｜ ｜ ｜ 07_13测试文件编写练习5答案.wmv [ 48.01MB ]
｜ ｜ ｜ ｜ 第08章 企业设计规范 [ 175.45MB ]
｜ ｜ ｜ ｜ ｜ 08_01明德扬规范.wmv [ 26.97MB ]
｜ ｜ ｜ ｜ ｜ 08_02一个always只设计一个信号.wmv [ 9.83MB ]
｜ ｜ ｜ ｜ ｜ 08_03时钟复位设计规范.wmv [ 3.24MB ]
｜ ｜ ｜ ｜ ｜ 08_04组合逻辑补全条件.wmv [ 2.17MB ]
｜ ｜ ｜ ｜ ｜ 08_05always练习1说明.wmv [ 39.31MB ]
｜ ｜ ｜ ｜ ｜ 08_06always练习1答案.wmv [ 93.93MB ]
｜ ｜ ｜ ｜ 第09章 明德扬模板 [ 24.23MB ]
｜ ｜ ｜ ｜ ｜ 09_01明德扬模板汇总.wmv [ 24.23MB ]
｜ ｜ ｜ ｜ 第10章 GVIM使用 [ 113.54MB ]
｜ ｜ ｜ ｜ ｜ 10_02GVIM的使用2.wmv [ 113.54MB ]
｜ ｜ ｜ ｜ 第11章 signaltap使用技巧 [ 11.11MB ]
｜ ｜ ｜ ｜ ｜ 11_01signaltapII使用.wmv [ 11.11MB ]
｜ ｜ ｜ ｜ 第12章 波形对比方法 [ 5.41MB ]
｜ ｜ ｜ ｜ ｜ 12_01波形对比方法.wmv [ 5.41MB ]
｜ ｜ ｜ ｜ 第13章计数器的使用 [ 795.77MB ]
｜ ｜ ｜ ｜ ｜ 13_01计数器的使用.wmv [ 80.33MB ]
｜ ｜ ｜ ｜ ｜ 13_02计数器练习1说明.avi [ 5.51MB ]
｜ ｜ ｜ ｜ ｜ 13_03计数器练习1答案.avi [ 8.75MB ]
｜ ｜ ｜ ｜ ｜ 13_04计数器练习2说明.avi [ 21.03MB ]
｜ ｜ ｜ ｜ ｜ 13_05计数器练习2答案.avi [ 107.50MB ]
｜ ｜ ｜ ｜ ｜ 13_06计数器练习3说明.avi [ 14.53MB ]
｜ ｜ ｜ ｜ ｜ 13_07计数器练习3答案.avi [ 72.25MB ]
｜ ｜ ｜ ｜ ｜ 13_08计数器练习4说明.avi [ 30.52MB ]
｜ ｜ ｜ ｜ ｜ 13_09计数器练习4答案.avi [ 53.00MB ]
｜ ｜ ｜ ｜ ｜ 13_10计数器练习5说明.avi [ 14.27MB ]
｜ ｜ ｜ ｜ ｜ 13_11计数器练习5答案.avi [ 59.38MB ]
｜ ｜ ｜ ｜ ｜ 13_12计数器练习6说明.avi [ 19.02MB ]
｜ ｜ ｜ ｜ ｜ 13_13计数器练习6答案.avi [ 73.89MB ]
｜ ｜ ｜ ｜ ｜ 13_14计数器练习7说明.avi [ 63.65MB ]
｜ ｜ ｜ ｜ ｜ 13_15计数器练习7答案.avi [ 172.13MB ]
｜ ｜ ｜ ｜ 第14章 状态机使用 [ 172.08MB ]
｜ ｜ ｜ ｜ ｜ 14_01状态机设计原则_转.wmv [ 21.92MB ]
｜ ｜ ｜ ｜ ｜ 14_02状态机练习1说明.wmv [ 1.09MB ]
｜ ｜ ｜ ｜ ｜ 14_03状态机练习1答案.wmv [ 1.82MB ]
｜ ｜ ｜ ｜ ｜ 14_04波形对比方法_转.wmv [ 3.29MB ]
｜ ｜ ｜ ｜ ｜ 14_05状态机练习2说明_转.wmv [ 889.11kB ]
｜ ｜ ｜ ｜ ｜ 14_06状态机练习2答案_转.wmv [ 2.94MB ]
｜ ｜ ｜ ｜ ｜ 14_07状态机练习3说明_转.wmv [ 1.31MB ]
｜ ｜ ｜ ｜ ｜ 14_08状态机练习3答案_转.wmv [ 3.37MB ]
｜ ｜ ｜ ｜ ｜ 14_09状态机练习4说明_转.avi [ 9.16MB ]
｜ ｜ ｜ ｜ ｜ 14_09状态机练习4说明_转.wmv [ 748.89kB ]
｜ ｜ ｜ ｜ ｜ 14_10状态机练习4答案_转.wmv [ 15.84MB ]
｜ ｜ ｜ ｜ ｜ 14_11状态机练习5说明_转.wmv [ 3.16MB ]
｜ ｜ ｜ ｜ ｜ 14_12状态机练习5答案_转.wmv [ 106.58MB ]
｜ ｜ ｜ ｜ 第15章 FPGA时序 [ 200.36MB ]
｜ ｜ ｜ ｜ ｜ 15_01FPGA时序原理_转.wmv [ 43.82MB ]
｜ ｜ ｜ ｜ ｜ 15_02用quartus分析时序_转.avi [ 151.27MB ]
｜ ｜ ｜ ｜ ｜ 15_03FPGA时序练习1说明_转.avi [ 5.27MB ]
｜ ｜ ｜ ｜ 第16章 流水线设计 [ 350.20MB ]
｜ ｜ ｜ ｜ ｜ 16_01为什么要进行流水线_转.avi [ 36.86MB ]
｜ ｜ ｜ ｜ ｜ 16_02流水线练习1说明_转.avi [ 15.79MB ]
｜ ｜ ｜ ｜ ｜ 16_03流水线练习1答案_转.avi [ 10.32MB ]
｜ ｜ ｜ ｜ ｜ 16_04流水线练习2说明_转.avi [ 7.78MB ]
｜ ｜ ｜ ｜ ｜ 16_05流水线练习2答案_转.avi [ 23.82MB ]
｜ ｜ ｜ ｜ ｜ 16_06流水线练习3说明.wmv [ 7.91MB ]
｜ ｜ ｜ ｜ ｜ 16_06流水线练习3说明_转.avi [ 9.94MB ]
｜ ｜ ｜ ｜ ｜ 16_07流水线练习3答案.wmv [ 8.49MB ]
｜ ｜ ｜ ｜ ｜ 16_07流水线练习3答案_转.avi [ 21.76MB ]
｜ ｜ ｜ ｜ ｜ 16_08流水线练习4说明.wmv [ 9.86MB ]
｜ ｜ ｜ ｜ ｜ 16_08流水线练习4说明_转.avi [ 13.65MB ]
｜ ｜ ｜ ｜ ｜ 16_09流水线练习4答案_转.avi [ 77.92MB ]
｜ ｜ ｜ ｜ ｜ 16_10流水线练习5说明.wmv [ 8.80MB ]
｜ ｜ ｜ ｜ ｜ 16_10流水线练习5说明_转.avi [ 18.31MB ]
｜ ｜ ｜ ｜ ｜ 16_11流水线练习5答案_转.avi [ 78.98MB ]
｜ ｜ ｜ ｜ 第17章 设计高级技巧-简化代码设计 [ 366.30MB ]
｜ ｜ ｜ ｜ ｜ 17_01简单代码的重要性_转.avi [ 20.97MB ]
｜ ｜ ｜ ｜ ｜ 17_02代码化简练习1说明_转.avi [ 12.72MB ]
｜ ｜ ｜ ｜ ｜ 17_03代码化简练习1答案_转.avi [ 86.99MB ]
｜ ｜ ｜ ｜ ｜ 17_04代码化简练习2说明_转.avi [ 5.71MB ]
｜ ｜ ｜ ｜ ｜ 17_05代码化简练习2答案_转.avi [ 130.20MB ]
｜ ｜ ｜ ｜ ｜ 17_06代码化简练习3说明_转.avi [ 9.94MB ]
｜ ｜ ｜ ｜ ｜ 17_07代码化简练习3答案_转.avi [ 99.76MB ]
｜ ｜ ｜ ｜ 第18章 FIFO的使用 [ 418.24MB ]
｜ ｜ ｜ ｜ ｜ 18_01FIFO原理_转.avi [ 85.75MB ]
｜ ｜ ｜ ｜ ｜ 18_02生成FIFO的IP核_转.avi [ 84.57MB ]
｜ ｜ ｜ ｜ ｜ 18_03如何验证带有IP核的代码_转.avi [ 38.56MB ]
｜ ｜ ｜ ｜ ｜ 18_04FIFO练习1说明_转.avi [ 31.35MB ]
｜ ｜ ｜ ｜ ｜ 18_05FIFO练习1答案_转.avi [ 48.40MB ]
｜ ｜ ｜ ｜ ｜ 18_06FIFO练习2说明_转.avi [ 20.96MB ]
｜ ｜ ｜ ｜ ｜ 18_07FIFO练习2答案_转.avi [ 39.63MB ]
｜ ｜ ｜ ｜ ｜ 18_08FIFO练习3说明_转.avi [ 28.65MB ]
｜ ｜ ｜ ｜ ｜ 18_09FIFO练习3答案_转.avi [ 40.37MB ]
｜ ｜ ｜ ｜ 第19章 异步时序处理 [ 522.28MB ]
｜ ｜ ｜ ｜ ｜ 19_01何为异步时序_转.avi [ 87.73MB ]
｜ ｜ ｜ ｜ ｜ 19_02三态门_转.avi [ 33.98MB ]
｜ ｜ ｜ ｜ ｜ 19_03异步时序练习1说明_转.avi [ 15.72MB ]
｜ ｜ ｜ ｜ ｜ 19_04异步时序练习1答案_转.avi [ 38.78MB ]
｜ ｜ ｜ ｜ ｜ 19_05异步时序练习2说明_转.avi [ 99.32MB ]
｜ ｜ ｜ ｜ ｜ 19_06异步时序练习2接口时序参数_转.avi [ 112.45MB ]
｜ ｜ ｜ ｜ ｜ 19_07异步时序练习2测试文件_转.avi [ 40.94MB ]
｜ ｜ ｜ ｜ ｜ 19_08异步时序练习2答案_转.avi [ 93.36MB ]
｜ ｜ ｜ ｜ 第20章 提高效率技巧 [ 50.04MB ]
｜ ｜ ｜ ｜ ｜ 20_01利用GVIM制作模板_转.avi [ 50.04MB ]
｜ ｜ ｜ FPGA设计系列 [ 5.75MB ]
｜ ｜ ｜ ｜ FPGA设计经验谈.pdf [ 929.25kB ]
｜ ｜ ｜ ｜ 非常经典的FPGA设计方法论.pdf [ 3.45MB ]
｜ ｜ ｜ ｜ 加速FPGA选择和系统设计的架构探索.pdf [ 305.98kB ]
｜ ｜ ｜ ｜ 实时视频SDRAM控制器的FPGA设计与实现.pdf [ 923.93kB ]
｜ ｜ ｜ ｜ 下载必看.txt [ 1.31kB ]
｜ ｜ ｜ ｜ 硬件工程师面试必看试题(经典).pdf [ 193.75kB ]
｜ ｜ ｜ fpga视频资料 [ 157.07GB ]
｜ ｜ ｜ ｜ 黑金科技.rar [ 1.91GB ]
｜ ｜ ｜ ｜ 0-zedboard [ 14.04GB ]
｜ ｜ ｜ ｜ ｜ 50,贯穿PL和PS以及驱动的嵌入式LINUX系统实现.rar [ 1.04GB ]
｜ ｜ ｜ ｜ ｜ 51,ZEDBOARD嵌入式LINUX平台搭建解压密码sysclk.taobao.com.rar [ 2.28GB ]
｜ ｜ ｜ ｜ ｜ ov7670采集以及显示系统详解以及实现2016_10_28.rar [ 1.54GB ]
｜ ｜ ｜ ｜ ｜ zedboard官方实例教程（英文）.zip [ 35.12MB ]
｜ ｜ ｜ ｜ ｜ Zynq SoC ZYNQ 7000资料汇总（官方）.zip [ 942.20MB ]
｜ ｜ ｜ ｜ ｜ ！！！视频下载！！！.txt [ 582B ]
｜ ｜ ｜ ｜ ｜ 视频教程发布 [ 8.22GB ]
｜ ｜ ｜ ｜ ｜ ｜ 10，使用NFS文件系统在开发过程中进行调试.rar [ 72.32MB ]
｜ ｜ ｜ ｜ ｜ ｜ 11，VIVADO下的逻辑仿真试验.rar [ 52.53MB ]
｜ ｜ ｜ ｜ ｜ ｜ 12，学习使用VIO以及进行试验.rar [ 264.17MB ]
｜ ｜ ｜ ｜ ｜ ｜ 13，PL和PS协同设计实现对OLED的控制.rar [ 450.45MB ]
｜ ｜ ｜ ｜ ｜ ｜ 14，综合分析PS和PL部分对OLED驱动进行加速.rar [ 226.98MB ]
｜ ｜ ｜ ｜ ｜ ｜ 15，FIFO的原理实现以及应用于PS与PL进行速度的协调.rar [ 171.96MB ]
｜ ｜ ｜ ｜ ｜ ｜ 16，MIO和EMIO下的GPIO分析和实例.rar [ 611.41MB ]
｜ ｜ ｜ ｜ ｜ ｜ 17，GPIO中断源的配置以及中断试验.rar [ 354.69MB ]
｜ ｜ ｜ ｜ ｜ ｜ 18，多路PWM原理分析以及实现试验.rar [ 330.12MB ]
｜ ｜ ｜ ｜ ｜ ｜ 19，中断控制部分的原理和SDK函数以及中断的试验.rar [ 188.27MB ]
｜ ｜ ｜ ｜ ｜ ｜ 1，测试视频.7z [ 76.67MB ]
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｜ ｜ ｜ ｜ ｜ ｜ 8，建立LINUX开发环境并编译LINUX和UBOOT以及生成设备树.rar [ 616.95MB ]
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｜ ｜ ｜ ｜ ｜ 1,测试视频.7z [ 76.67MB ]
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｜ ｜ ｜ ｜ 4-明德扬FPGA 135个 [ 4.31GB ]
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｜ ｜ ｜ ｜ ｜ 19_01何为异步时序_转.avi [ 87.73MB ]
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｜ ｜ ｜ ｜ ｜ 19_08异步时序练习2答案_转.avi [ 93.36MB ]
｜ ｜ ｜ ｜ ｜ 20_01利用GVIM制作模板_转.avi [ 50.04MB ]
｜ ｜ ｜ ｜ 4-明德扬点拨FPGA视频 [ 7.92GB ]
｜ ｜ ｜ ｜ ｜ 课程简介.docx [ 33.11kB ]
｜ ｜ ｜ ｜ ｜ 明德扬点拨FPGA课程学习指导.pdf [ 951.99kB ]
｜ ｜ ｜ ｜ ｜ 明德扬科教之Gvim_20170511.zip [ 8.52MB ]
｜ ｜ ｜ ｜ ｜ 第1部分 软件基础 视频 [ 1.49GB ]
｜ ｜ ｜ ｜ ｜ ｜ 第0章 [ 49.12MB ]
｜ ｜ ｜ ｜ ｜ ｜ 第1章 软件安装 [ 36.54MB ]
｜ ｜ ｜ ｜ ｜ ｜ 第2章 quartus使用 [ 29.46MB ]
｜ ｜ ｜ ｜ ｜ ｜ 第3章 入门基础 [ 125.26MB ]
｜ ｜ ｜ ｜ ｜ ｜ 第4章 modelsim使用 [ 197.66MB ]
｜ ｜ ｜ ｜ ｜ ｜ 第5章 verilog快速掌握 [ 327.71MB ]
｜ ｜ ｜ ｜ ｜ ｜ 第6章 测试文件 [ 438.80MB ]
｜ ｜ ｜ ｜ ｜ ｜ 第7章 明德扬设计规范 [ 175.45MB ]
｜ ｜ ｜ ｜ ｜ ｜ 第8章 signaltap使用 [ 11.11MB ]
｜ ｜ ｜ ｜ ｜ ｜ 第9章 GVIM使用 [ 137.77MB ]
｜ ｜ ｜ ｜ ｜ 第2部分 设计基础 视频 [ 967.11MB ]
｜ ｜ ｜ ｜ ｜ ｜ 第1章计数器 [ 795.77MB ]
｜ ｜ ｜ ｜ ｜ ｜ 第2章 状态机 [ 171.35MB ]
｜ ｜ ｜ ｜ ｜ 第4部分 经典笔试面试 视频 [ 2.93GB ]
｜ ｜ ｜ ｜ ｜ ｜ 第1章 FPGA时序 [ 200.36MB ]
｜ ｜ ｜ ｜ ｜ ｜ 第2章 流水线 [ 286.54MB ]
｜ ｜ ｜ ｜ ｜ ｜ 第3章 FIFO [ 528.50MB ]
｜ ｜ ｜ ｜ ｜ ｜ 第4章 异步时序 [ 522.28MB ]
｜ ｜ ｜ ｜ ｜ ｜ 第5章 代码化简 [ 366.30MB ]
｜ ｜ ｜ ｜ ｜ ｜ 第6章 FPGA知识大串讲 [ 1.07GB ]
｜ ｜ ｜ ｜ ｜ 课程参考资料12个 [ 621.75kB ]
｜ ｜ ｜ ｜ ｜ ｜ 03_01第一个上板例程 [ 14.16kB ]
｜ ｜ ｜ ｜ ｜ ｜ 03_02key_light [ 14.28kB ]
｜ ｜ ｜ ｜ ｜ ｜ 04_01verilog详细讲解 [ 6.81kB ]
｜ ｜ ｜ ｜ ｜ ｜ 05_03modelsim初级练习1 [ 2.39kB ]
｜ ｜ ｜ ｜ ｜ ｜ 05_05modelsim初级练习2 [ 2.35kB ]
｜ ｜ ｜ ｜ ｜ ｜ 05_07modelsim初级练习3 [ 2.17kB ]
｜ ｜ ｜ ｜ ｜ ｜ 05_09modelsim一级练习1 [ 2.04kB ]
｜ ｜ ｜ ｜ ｜ ｜ 05_11modelsim一级练习2 [ 2.87kB ]
｜ ｜ ｜ ｜ ｜ ｜ 06_09verilog快速掌握练习1 [ 185.63kB ]
｜ ｜ ｜ ｜ ｜ ｜ 06_10verilog快速掌握练习2 [ 187.01kB ]
｜ ｜ ｜ ｜ ｜ ｜ 06_11verilog快速掌握练习3 [ 199.82kB ]
｜ ｜ ｜ ｜ ｜ ｜ 07_06测试文件编写练习2 [ 2.22kB ]
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｜ ｜ ｜ ｜ 《Verilog HDL设计与实战》配套视频 [ 2.00GB ]
｜ ｜ ｜ ｜ ｜ 第10章 Verilog HDL的测试平台编写.avi [ 35.83MB ]
｜ ｜ ｜ ｜ ｜ 第11章 Verilog HDL设计规范.avi [ 57.16MB ]
｜ ｜ ｜ ｜ ｜ 第12章 Verilog HDL基本组合电路建模.avi [ 59.17MB ]
｜ ｜ ｜ ｜ ｜ 第13章 Verilog HDL的基本时序电路建模.avi [ 41.42MB ]
｜ ｜ ｜ ｜ ｜ 第14章 信道加密与解密.avi [ 22.97MB ]
｜ ｜ ｜ ｜ ｜ 第15章 CRC编码.avi [ 36.90MB ]
｜ ｜ ｜ ｜ ｜ 第16章 数字钟设计.avi [ 76.05MB ]
｜ ｜ ｜ ｜ ｜ 第17章 HDB3编码与译码.avi [ 110.92MB ]
｜ ｜ ｜ ｜ ｜ 第18章 SPI 数据通信.avi [ 76.19MB ]
｜ ｜ ｜ ｜ ｜ 第19章 UART 数据通信.avi [ 43.95MB ]
｜ ｜ ｜ ｜ ｜ 第1章 ModelSim仿真工具与Quartus II开发工具的基本操作.avi [ 154.07MB ]
｜ ｜ ｜ ｜ ｜ 第20章 交通灯控制器建模.avi [ 23.70MB ]
｜ ｜ ｜ ｜ ｜ 第21章 基于Qsys的第一个Nios II 系统.avi [ 92.07MB ]
｜ ｜ ｜ ｜ ｜ 第22章 PIO核的应用系统.avi [ 207.05MB ]
｜ ｜ ｜ ｜ ｜ 第23章 UART核的应用.avi [ 127.56MB ]
｜ ｜ ｜ ｜ ｜ 第24章 Interval Timer核的应用.avi [ 144.78MB ]
｜ ｜ ｜ ｜ ｜ 第25章 SPI核的应用.avi [ 91.69MB ]
｜ ｜ ｜ ｜ ｜ 第26章 基于Qsys的自定义外设与指令.avi [ 83.88MB ]
｜ ｜ ｜ ｜ ｜ 第2章 Verilog HDL的简要介绍.avi [ 82.15MB ]
｜ ｜ ｜ ｜ ｜ 第3章 Verilog HDL的数据对象.avi [ 54.43MB ]
｜ ｜ ｜ ｜ ｜ 第4章 Verilog HDL操作符.avi [ 89.63MB ]
｜ ｜ ｜ ｜ ｜ 第5章 Verilog HDL的并行语句.avi [ 109.50MB ]
｜ ｜ ｜ ｜ ｜ 第6章 Verilog HDL的顺序语句.avi [ 52.03MB ]
｜ ｜ ｜ ｜ ｜ 第7章 Verilog HDL的自定义原语（UDP）.avi [ 42.24MB ]
｜ ｜ ｜ ｜ ｜ 第8章 Verilog HDL的任务与函数.avi [ 60.31MB ]
｜ ｜ ｜ ｜ ｜ 第9章 Verilog HDL的其它语法知识.avi [ 73.87MB ]
｜ ｜ ｜ 华为FPGA设计资料 [ 5.23MB ]
｜ ｜ ｜ ｜ FPGA设计高级技巧Xilinx篇.pdf [ 2.94MB ]
｜ ｜ ｜ ｜ Verilog HDL 代码书写规范.pdf [ 210.92kB ]
｜ ｜ ｜ ｜ Verilog+HDL入门教程.pdf [ 281.48kB ]
｜ ｜ ｜ ｜ Verilog_HDL_华为入门教程.pdf [ 308.91kB ]
｜ ｜ ｜ ｜ Verilog基本电路设计指导书.pdf [ 383.79kB ]
｜ ｜ ｜ ｜ VHDL设计风格和实现.ppt [ 426.50kB ]
｜ ｜ ｜ ｜ 华为FPGA设计流程指南.doc [ 131.50kB ]
｜ ｜ ｜ ｜ 静态时序分析与逻辑…pdf [ 597.62kB ]
｜ ｜ ｜ 手把手教你FPGA与RT以及Host端通信 [ 16.28MB ]
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｜ ｜ ｜ Perl语言应用视频教程 [ 1.19GB ]
｜ ｜ ｜ ｜ 0 Perl Overview And Basic Syntax.mp4 [ 61.31MB ]
｜ ｜ ｜ ｜ 1 Perl Overview.mp4 [ 40.75MB ]
｜ ｜ ｜ ｜ 2 Basic Syntax and Hashes.mp4 [ 166.84MB ]
｜ ｜ ｜ ｜ 3.1 Pattern Matching And Regular Expression (1).mp4 [ 90.48MB ]
｜ ｜ ｜ ｜ 3.2 Pattern Matching And Regular Expression (2).mp4 [ 97.66MB ]
｜ ｜ ｜ ｜ 3.3 Pattern Matching And Regular Expression (3).mp4 [ 82.84MB ]
｜ ｜ ｜ ｜ 4 Pattern Matching And Regular Expression (4) & Control structure.mp4 [ 108.56MB ]
｜ ｜ ｜ ｜ 5 File And Dir Operations.mp4 [ 80.62MB ]
｜ ｜ ｜ ｜ 6 Strings and sorting & Process Management.mp4 [ 115.64MB ]
｜ ｜ ｜ ｜ 7.1 Some Examples In SoC Verification.mp4 [ 117.96MB ]
｜ ｜ ｜ ｜ 7.2 Some Examples In SoC Verification.mp4 [ 112.06MB ]
｜ ｜ ｜ ｜ 7.3 Some Examples In SoC Verification.mp4 [ 140.75MB ]
｜ ｜ ｜ ｜ Perl_examples.rar [ 60.01kB ]
｜ ｜ ｜ 【E课网】verdi升级版 [ 932.41MB ]
｜ ｜ ｜ ｜ Verdi-升级版-3小时.mp4 [ 932.41MB ]
｜ ｜ ｜ 【E课网数字IC版图实训视频】 [ 10.22GB ]
｜ ｜ ｜ ｜ 课时10：RM Flow and Lab.mp4 [ 645.53MB ]
｜ ｜ ｜ ｜ 课时11：Placement.mp4 [ 400.19MB ]
｜ ｜ ｜ ｜ 课时12：CTS 1.mp4 [ 201.30MB ]
｜ ｜ ｜ ｜ 课时12：CTS 2.mp4 [ 91.81MB ]
｜ ｜ ｜ ｜ 课时13：Routing.mp4 [ 322.72MB ]
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｜ ｜ ｜ ｜ 课时15：summary.mp4 [ 257.80MB ]
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｜ ｜ ｜ ｜ 课时17：Introduction.mp4 [ 203.02MB ]
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｜ ｜ ｜ ｜ 课时2：数字IC设计基础.mp4 [ 201.28MB ]
｜ ｜ ｜ ｜ 课时3：逻辑综合1.mp4 [ 183.36MB ]
｜ ｜ ｜ ｜ 课时4：逻辑综合2.mp4 [ 277.42MB ]
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｜ ｜ ｜ ｜ 课时6：形式验证.mp4 [ 368.01MB ]
｜ ｜ ｜ ｜ 课时7：Introduction and overview.mp4 [ 334.60MB ]
｜ ｜ ｜ ｜ 课时8：Data setup and Basic Flow.mp4 [ 569.34MB ]
｜ ｜ ｜ ｜ 课时9：Design Planning.mp4 [ 302.16MB ]
｜ ｜ ｜ 【顾卫钢】手把手教你学习DSP [ 2.45GB ]
｜ ｜ ｜ ｜ 第10课 时钟和系统控制.flv [ 66.04MB ]
｜ ｜ ｜ ｜ 第11课 多路复用器GPIO.flv [ 89.92MB ]
｜ ｜ ｜ ｜ 第12课 CPU定时器（1）.flv [ 64.51MB ]
｜ ｜ ｜ ｜ 第12课 CPU定时器（2）.flv [ 31.51MB ]
｜ ｜ ｜ ｜ 第13课 三级中断系统（1）.flv [ 89.39MB ]
｜ ｜ ｜ ｜ 第13课 三级中断系统（2）.flv [ 130.37MB ]
｜ ｜ ｜ ｜ 第14课 事件管理器之通用定时器.flv [ 225.89MB ]
｜ ｜ ｜ ｜ 第15课 事件管理器之比较单元与PWM电路.flv [ 108.73MB ]
｜ ｜ ｜ ｜ 第16课 捕获单元和正交编码电路.flv [ 142.75MB ]
｜ ｜ ｜ ｜ 第17课 ADC模块（1）.flv [ 104.33MB ]
｜ ｜ ｜ ｜ 第17课 ADC模块（2）.flv [ 64.93MB ]
｜ ｜ ｜ ｜ 第17课 ADC模块（3）.flv [ 72.80MB ]
｜ ｜ ｜ ｜ 第18课 SCI模块（1）.flv [ 57.37MB ]
｜ ｜ ｜ ｜ 第18课 SCI模块（2）.flv [ 70.62MB ]
｜ ｜ ｜ ｜ 第18课 SCI模块（3）.flv [ 63.00MB ]
｜ ｜ ｜ ｜ 第19课 SPI模块（1）.flv [ 59.08MB ]
｜ ｜ ｜ ｜ 第19课 SPI模块（2）.flv [ 116.48MB ]
｜ ｜ ｜ ｜ 第1课 如何让开始DSP的学习和开发.flv [ 80.64MB ]
｜ ｜ ｜ ｜ 第20课 eCAN模块（1）.flv [ 24.18MB ]
｜ ｜ ｜ ｜ 第20课 eCAN模块（2）.flv [ 108.51MB ]
｜ ｜ ｜ ｜ 第20课 eCAN模块（3）.flv [ 60.87MB ]
｜ ｜ ｜ ｜ 第20课 eCAN模块（4）.flv [ 111.78MB ]
｜ ｜ ｜ ｜ 第2课 F2812的资源、性能及结构.flv [ 38.31MB ]
｜ ｜ ｜ ｜ 第3课 F2812的硬件设计.flv [ 62.74MB ]
｜ ｜ ｜ ｜ 第4课 一个完整的工程由哪些部分构成.flv [ 41.22MB ]
｜ ｜ ｜ ｜ 第5课 揭秘GEL文件.flv [ 74.59MB ]
｜ ｜ ｜ ｜ 第6课 手把手教你创建新工程.flv [ 61.21MB ]
｜ ｜ ｜ ｜ 第7课 使用C语言操作DSP的寄存器.flv [ 99.03MB ]
｜ ｜ ｜ ｜ 第8课 F2812的存储器映像.flv [ 88.10MB ]
｜ ｜ ｜ ｜ 第9课 CMD文件的编写.flv [ 97.00MB ]
｜ ｜ ｜ 【启芯工作室SOC芯片设计工程师职业培训】低功耗设计方法学UPF理论和实践 [ 1.88GB ]
｜ ｜ ｜ ｜ 任务1：UPF1-2.mp4 [ 581.02MB ]
｜ ｜ ｜ ｜ 任务2：UPF3.mp4 [ 550.00MB ]
｜ ｜ ｜ ｜ 任务3：UPF4.mp4 [ 355.05MB ]
｜ ｜ ｜ ｜ 任务4：UPF5.mp4 [ 282.13MB ]
｜ ｜ ｜ ｜ 任务5：UPF6.mp4 [ 158.62MB ]
｜ ｜ ｜ 【启芯工作室】AHB-SRAM [ 3.94GB ]
｜ ｜ ｜ ｜ 课时1 AHB-SRAM 01.mp4 [ 683.97MB ]
｜ ｜ ｜ ｜ 课时2 AHB-SRAM 02.mp4 [ 1.17GB ]
｜ ｜ ｜ ｜ 课时3：AHB-SRAM 03.mp4 [ 559.15MB ]
｜ ｜ ｜ ｜ 课时4 AHB-SRAM 04.mp4 [ 403.29MB ]
｜ ｜ ｜ ｜ 课时5：AHB-SRAM 05.mp4 [ 703.86MB ]
｜ ｜ ｜ ｜ 课时6 AHB-SRAM 06.mp4 [ 488.77MB ]
｜ ｜ ｜ 【启芯工作室】Verilog RTL实践视频 [ 2.42GB ]
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｜ ｜ ｜ 【启芯学堂】IP项目专题AHB-SRAMC的设计与验证 [ 1.15GB ]
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｜ ｜ ｜ 【启芯学堂】PrimeTime视频教程 [ 3.64GB ]
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｜ ｜ ｜ 【启芯学堂】布局布线ICC视频 [ 1.67GB ]
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｜ ｜ ｜ ｜ ICC教学视频 [ 82.07MB ]
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｜ ｜ ｜ ｜ ｜ ICC官方视频教程 [ 42.75MB ]
｜ ｜ ｜ ｜ ｜ ｜ Part 1 – icc_gui cockpit overview – cockpit_demo.swf [ 12.63MB ]
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｜ ｜ ｜ ｜ ｜ ICC演示视频教程 [ 15.98MB ]
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｜ ｜ ｜ 【启芯学堂电路设计透视视频】 [ 2.19GB ]
｜ ｜ ｜ ｜ 数字电路设计透视 01 Instroduction_高清.mp4 [ 272.80MB ]
｜ ｜ ｜ ｜ 数字电路设计透视 02 Process_高清.mp4 [ 210.19MB ]
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｜ ｜ ｜ ｜ 数字电路设计透视 05 Inverter_高清.mp4 [ 270.41MB ]
｜ ｜ ｜ ｜ 数字电路设计透视 06 Combinational Circuit_高清.mp4 [ 228.08MB ]
｜ ｜ ｜ ｜ 数字电路设计透视 07 Sequential Circuit_高清.mp4 [ 230.53MB ]
｜ ｜ ｜ ｜ 数字电路设计透视 08 Design Methodology_高清.mp4 [ 73.74MB ]
｜ ｜ ｜ ｜ 数字电路设计透视 09 Interconnect_高清.mp4 [ 87.24MB ]
｜ ｜ ｜ ｜ 数字电路设计透视 10 Timing_高清.mp4 [ 230.36MB ]
｜ ｜ ｜ ｜ 数字电路设计透视 11 Arithemitc circuit_高清.mp4 [ 215.34MB ]
｜ ｜ ｜ 【启芯学堂仿真工具实践VCS】 [ 1.21GB ]
｜ ｜ ｜ ｜ 1 VCS simulation basics.mov [ 157.98MB ]
｜ ｜ ｜ ｜ 2 VCS debugging basics.mov [ 181.58MB ]
｜ ｜ ｜ ｜ 3 Debugging with DVE.mov [ 282.89MB ]
｜ ｜ ｜ ｜ 4 Post-processing with VCD+ file.mov [ 179.33MB ]
｜ ｜ ｜ ｜ 5 Debugging simulation mismatches.mov [ 176.62MB ]
｜ ｜ ｜ ｜ 6 Fast Gate-level verification.mov [ 139.00MB ]
｜ ｜ ｜ ｜ 7 Code coverage.mov [ 120.75MB ]
｜ ｜ ｜ ｜ VCS_labs.rar [ 167.16kB ]
｜ ｜ ｜ 验证集合(SV UVM) [ 49.71GB ]
｜ ｜ ｜ ｜ SV集合 [ 19.51GB ]
｜ ｜ ｜ ｜ ｜ SystemVerilog for Verification-12个视频 [ 820.49MB ]
｜ ｜ ｜ ｜ ｜ ｜ 1 DUT.flv [ 63.35MB ]
｜ ｜ ｜ ｜ ｜ ｜ 10 OOP-Inheritance.flv [ 33.05MB ]
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｜ ｜ ｜ ｜ ｜ ｜ 13 VMM Preview.flv [ 27.19MB ]
｜ ｜ ｜ ｜ ｜ ｜ 2 Verification Environment.flv [ 83.71MB ]
｜ ｜ ｜ ｜ ｜ ｜ 3 SystemVerilog Language Basics.flv [ 117.81MB ]
｜ ｜ ｜ ｜ ｜ ｜ 4 Language Basic two.flv [ 34.52MB ]
｜ ｜ ｜ ｜ ｜ ｜ 5 Stimulus driven and received.flv [ 40.00MB ]
｜ ｜ ｜ ｜ ｜ ｜ 6 Concurrency.flv [ 109.11MB ]
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｜ ｜ ｜ ｜ ｜ ｜ 8 Virtual Interface.flv [ 18.98MB ]
｜ ｜ ｜ ｜ ｜ ｜ 9 OOP-Randomization.flv [ 89.74MB ]
｜ ｜ ｜ ｜ ｜ SystemVerilog Verification-13个视频 [ 6.75GB ]
｜ ｜ ｜ ｜ ｜ ｜ SV labs code.rar [ 5.55MB ]
｜ ｜ ｜ ｜ ｜ ｜ SVV_Labs.tar.gz [ 7.14MB ]
｜ ｜ ｜ ｜ ｜ ｜ SV_01_course_overview.avi [ 442.32MB ]
｜ ｜ ｜ ｜ ｜ ｜ SV_02_verification_environment.avi [ 417.21MB ]
｜ ｜ ｜ ｜ ｜ ｜ SV_03_interface_program.avi [ 864.50MB ]
｜ ｜ ｜ ｜ ｜ ｜ SV_04_Data_types_01.avi [ 529.78MB ]
｜ ｜ ｜ ｜ ｜ ｜ SV_04_Data_types_02.avi [ 540.02MB ]
｜ ｜ ｜ ｜ ｜ ｜ SV_05_program_basics.mp4 [ 55.48MB ]
｜ ｜ ｜ ｜ ｜ ｜ SV_06_OOP.avi [ 854.47MB ]
｜ ｜ ｜ ｜ ｜ ｜ SV_07_Randomization.mp4 [ 101.98MB ]
｜ ｜ ｜ ｜ ｜ ｜ SV_08_fork_and_communication.avi [ 607.25MB ]
｜ ｜ ｜ ｜ ｜ ｜ SV_09_threads_IPC.avi [ 421.57MB ]
｜ ｜ ｜ ｜ ｜ ｜ SV_10_assertion_summary.avi [ 846.29MB ]
｜ ｜ ｜ ｜ ｜ ｜ SV_11_sva_sequence.mp4 [ 89.43MB ]
｜ ｜ ｜ ｜ ｜ ｜ SV_12_assertion_property.avi [ 588.43MB ]
｜ ｜ ｜ ｜ ｜ ｜ SV_13_coverage.avi [ 540.11MB ]
｜ ｜ ｜ ｜ ｜ 【E课网验证实训班 UVM实训课程】sv15个-课时 [ 3.34GB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时1 ASIC Functional Verification [ 401.11MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时1 数字前端笔试经典题精讲 Part1 [ 281.49MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时10 SystemVerilog Data Types – Array, struct, emu, string, operators [ 266.04MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时11 SystemVerilog 基本编程：task 和 functio [ 233.44MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时12 SystemVerilog 面向对象编 [ 171.31MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时13 SystemVerilog 面向对象高级编 [ 141.82MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时14 SystemVerilog 随机化 – randomizatio [ 251.57MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时15 lab2 – 数据建模packet – constrainted random stimulus [ 205.68MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时16 SystemVerilog 线程 [ 150.21MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时17 SystemVerilog 内部线程信 [ 106.17MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时18 lab3 利用OOP编写packet， generator，driver等组件 [ 203.49MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时19 lab4 利用SystemVerilog的OOP属性编写 receiver， scoreboard，构建分层的SVT [ 223.40MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时2 ASIC验证的基本概念 [ 354.69MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时20 SystemVerilog Functinal Coverage [ 190.76MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时21 SystemVerilog Assertion 基本概念 [ 237.80MB ]
｜ ｜ ｜ ｜ ｜ 【E课网验证实训班 UVM实训课程】UVM实训201703月 [ 7.23GB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时1 ASIC Functional Verification [ 401.11MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时1 数字前端笔试经典题精讲 Part1 [ 281.49MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时10 SystemVerilog Data Types – Array, struct, emu, string, operators [ 266.04MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时11 SystemVerilog 基本编程：task 和 functio [ 233.44MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时12 SystemVerilog 面向对象编 [ 171.31MB ]
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｜ ｜ ｜ ｜ ｜ ｜ 课时15 lab2 – 数据建模packet – constrainted random stimulus [ 205.68MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时16 SystemVerilog 线程 [ 150.21MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时17 SystemVerilog 内部线程信 [ 106.17MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时18 lab3 利用OOP编写packet， generator，driver等组件 [ 203.49MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时19 lab4 利用SystemVerilog的OOP属性编写 receiver， scoreboard，构建分层的SVT [ 223.40MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时2 ASIC验证的基本概念 [ 354.69MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时20 SystemVerilog Functinal Coverage [ 190.76MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时21 SystemVerilog Assertion 基本概念 [ 237.80MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时22 SystemVerilog Assertion definition [ 194.71MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时23 SystemVerilog Assert- property [ 236.18MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时24 SystemVerilog Assertion Sequence [ 0B ]
｜ ｜ ｜ ｜ ｜ ｜ 课时25 SystemVerilog Assertion practice [ 144.86MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时3 如何验证一个32位的加法器？ [ 387.64MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时4 SystemVerilog Functional Verificatio [ 1.55GB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时5 ASIC 验证环境 [ 314.43MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时6 待验证RTL的设计规格 – DUT 介绍 [ 230.69MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时7 SystemVerilog interface 和 progra [ 524.24MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时8 基本的systemverilog验证平台的组成 [ 172.43MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时9 实验1：Interface 和 Program的代码编写、编译和仿真 [ 188.50MB ]
｜ ｜ ｜ ｜ ｜ 【启芯学堂】09 验证课 SystemVerilog Assertion [ 1.39GB ]
｜ ｜ ｜ ｜ ｜ ｜ 01_SVA_Methodology.mp4 [ 205.33MB ]
｜ ｜ ｜ ｜ ｜ ｜ 02 SystemVerilog Assertion Types.mp4 [ 247.28MB ]
｜ ｜ ｜ ｜ ｜ ｜ 03 SVA checker library and AIP.mp4 [ 141.81MB ]
｜ ｜ ｜ ｜ ｜ ｜ SVA01.mp4 [ 100.86MB ]
｜ ｜ ｜ ｜ ｜ ｜ SVA02.mp4 [ 71.87MB ]
｜ ｜ ｜ ｜ ｜ ｜ SVA03.mp4 [ 124.87MB ]
｜ ｜ ｜ ｜ ｜ ｜ SVA04.mp4 [ 134.92MB ]
｜ ｜ ｜ ｜ ｜ ｜ SVA05.mp4 [ 47.99MB ]
｜ ｜ ｜ ｜ ｜ ｜ SVA06.mp4 [ 26.58MB ]
｜ ｜ ｜ ｜ ｜ ｜ SVA07.mp4 [ 29.01MB ]
｜ ｜ ｜ ｜ ｜ ｜ SVA08.mp4 [ 85.74MB ]
｜ ｜ ｜ ｜ ｜ ｜ SVA09.mp4 [ 104.14MB ]
｜ ｜ ｜ ｜ ｜ ｜ SVA10.mp4 [ 104.14MB ]
｜ ｜ ｜ ｜ ｜ ｜ sva_lab.rar [ 1.27MB ]
｜ ｜ ｜ ｜ UVM集合 [ 30.20GB ]
｜ ｜ ｜ ｜ ｜ 【CSIPE课网UVM验证班】UVM验证实战-3月 [ 3.63GB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务10：SD-HOST SPEC讲解.mp4 [ 257.51MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务11：SD-HOST SPEC讲解2.mp4 [ 165.12MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务13：SH HOST验证计划.mp4 [ 156.47MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务14：SD HOST验证计划2.mp4 [ 204.46MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务15：SD HOST UVM TB 1.mp4 [ 202.40MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务15：SD HOST UVM TB 2.mp4 [ 218.80MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务17：SD HOST寄存器测试test.mp4 [ 196.59MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务18：SD HOST sdio agent.mp4 [ 194.34MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务19：SD HOST sd cmd test.mp4 [ 288.12MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务1：APB-SPI模块验证–SPEC和TESTPLAN讲解.mp4 [ 115.50MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务20：SD HOST sd data.mp4 [ 189.47MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务21：SD HOST coverage assertion 1.mp4 [ 83.96MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务21：SD HOST coverage assertion 2.mp4 [ 66.20MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务2：APB-SPI验证计划编写讲解2.mp4 [ 206.83MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务3：APB-SPI UVM-RAL验证平台的搭建.mp4 [ 112.16MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务4：APB-SPI UVM-RAL 平台讲解2.mp4 [ 190.29MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务5：APB-SPI UVM RAL平台的自动生成讲解.mp4 [ 208.66MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务6：UVM平台和功能覆盖率讲解.mp4 [ 243.99MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务7：testcase 和 coverage 讲解.mp4 [ 230.19MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务8：SPI验证总结.mp4 [ 103.29MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务9：SPI项目总结2.mp4 [ 80.13MB ]
｜ ｜ ｜ ｜ ｜ 【E课网】UVM实训201703月 [ 7.23GB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时1 ASIC Functional Verification [ 401.11MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时1 数字前端笔试经典题精讲 Part1 [ 281.49MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时10 SystemVerilog Data Types – Array, struct, emu, string, operators [ 266.04MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时11 SystemVerilog 基本编程：task 和 functio [ 233.44MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时12 SystemVerilog 面向对象编 [ 171.31MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时13 SystemVerilog 面向对象高级编 [ 141.82MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时14 SystemVerilog 随机化 – randomizatio [ 251.57MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时15 lab2 – 数据建模packet – constrainted random stimulus [ 205.68MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时16 SystemVerilog 线程 [ 150.21MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时17 SystemVerilog 内部线程信 [ 106.17MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时18 lab3 利用OOP编写packet， generator，driver等组件 [ 203.49MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时19 lab4 利用SystemVerilog的OOP属性编写 receiver， scoreboard，构建分层的SVT [ 223.40MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时2 ASIC验证的基本概念 [ 354.69MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时20 SystemVerilog Functinal Coverage [ 190.76MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时21 SystemVerilog Assertion 基本概念 [ 237.80MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时22 SystemVerilog Assertion definition [ 194.71MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时23 SystemVerilog Assert- property [ 236.18MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时24 SystemVerilog Assertion Sequence [ 0B ]
｜ ｜ ｜ ｜ ｜ ｜ 课时25 SystemVerilog Assertion practice [ 144.86MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时3 如何验证一个32位的加法器？ [ 387.64MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时4 SystemVerilog Functional Verificatio [ 1.55GB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时5 ASIC 验证环境 [ 314.43MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时6 待验证RTL的设计规格 – DUT 介绍 [ 230.69MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时7 SystemVerilog interface 和 progra [ 524.24MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时8 基本的systemverilog验证平台的组成 [ 172.43MB ]
｜ ｜ ｜ ｜ ｜ ｜ 课时9 实验1：Interface 和 Program的代码编写、编译和仿真 [ 188.50MB ]
｜ ｜ ｜ ｜ ｜ 【E课网】UVM实战培训11月 [ 7.85GB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务10：SystemVerilog data types second part.mp4 [ 144.25MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务11：lab讲解 和testplan点评.mp4 [ 160.49MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务12：SystemVerilog Procedural Statements and Routines.mp4 [ 132.51MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务13：Object Oriented Programming.mp4 [ 110.98MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务14：Object Oriented Programming and Randomization.mp4 [ 142.83MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务15：Randomization .mp4 [ 86.52MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务16：lab2讲解及lab1问答题讲解.mp4 [ 151.46MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务17：Threads and inter-process communication .mp4 [ 117.30MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务18：Events and Inter-process Communication.mp4 [ 149.46MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务19：lab3和lab4的讲解 .mp4 [ 178.67MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务1：ASIC功能验证Verilog TB.mp4 [ 100.90MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务20：SystemVerilog Coverage .mp4 [ 130.78MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务21：SystemVerilog Assertion Summary .mp4 [ 185.12MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务22：lab5讲解.mp4 [ 62.83MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务23：SystemVerilog Assertion Sequence.mp4 [ 90.11MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务24：SystemVerilog Assertion Property.mp4 [ 118.22MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务25：lab6讲解 .mp4 [ 61.65MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务26：UVM-OOP.mp4 [ 141.65MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务27：UVM-components 介绍、讲解.mp4 [ 104.94MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务28：UVM-testbench architecture.mp4 [ 173.74MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务29：UVM-TB components 讲解 .mp4 [ 126.14MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务2：ASIC功能验证Verilog TB续.mp4 [ 87.88MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务30：UVM-objection 管理讲解.mp4 [ 63.53MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务31：uvm_sequence_item property and methods 讲解 .mp4 [ 93.74MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务32：uvm_sequence_item methods讲解.mp4 [ 213.07MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务33：uvm_sequence architecture and methods 讲解.mp4 [ 161.95MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务34：uvm_sequence 调度方法讲解.mp4 [ 151.21MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务35：uvm_sequence 调度-续.mp4 [ 115.77MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务36：uvm_component methods configure 讲解.mp4 [ 76.70MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务37：UVM TLM communication.mp4 [ 143.71MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务38：UVM scoreboard coverage 讲解.mp4 [ 158.09MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务39：UVM callback 讲解.mp4 [ 180.65MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务3：ASIC功能验证SVTB.mp4 [ 83.36MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务40：uvm virtual sequence and sequencer.mp4 [ 175.01MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务41：UVM-RAL 讲解.mp4 [ 124.76MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务42：UVM-RAL 讲解2 .mp4 [ 132.25MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务43：UVM-RAL 讲解3 .mp4 [ 151.48MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务44：UVM-RAL 讲解4.mp4 [ 94.96MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务45：I2C 协议讲解.mp4 [ 132.82MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务46：I2C 协议讲解2.mp4 [ 189.20MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务47：I2C UVM 平台详解.mp4 [ 223.86MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务48：I2C UVM 平台讲解2.mp4 [ 66.68MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务49：I2C UVM 平台讲解3 .mp4 [ 183.86MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务4：ASIC功能验证续.mp4 [ 156.45MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务50：SPI 协议介绍 .mp4 [ 171.34MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务51：SPI Test Plan 讲解.mp4 [ 124.20MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务52：RAL 在SPI 项目中的应用.mp4 [ 198.20MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务53：UVM RAL 在SPI 项目中的应用讲解2 .mp4 [ 76.88MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务54：Coverage 在SPI 项目中的应用 .mp4 [ 274.51MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务55：SDMMC协议介绍 .mp4 [ 174.99MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务56：SDMMC协议2 .mp4 [ 179.96MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务57：SRAM验证平台演示.mp4 [ 206.98MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务58：创建sramc数据收发case .mp4 [ 106.63MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务5：ASIC验证环境.mp4 [ 128.03MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务6：SVV实验_DUT手册.mp4 [ 127.50MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务7：SystemVerilog Interfaces，Program.mp4 [ 106.17MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务8：SystemVerilog Interface，Program.mp4 [ 201.21MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务9：SystemVerilog data types first part.mp4 [ 134.70MB ]
｜ ｜ ｜ ｜ ｜ 【E课网】UVM验证及其进阶-3月 [ 3.87GB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务10：UVM10-Component_configuration.mp4 [ 172.11MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务11：UVM11-Factory.mp4 [ 97.32MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务12：UVM12-TLM_communication.mp4 [ 191.44MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务13：UVM13-TLM_communication2.mp4 [ 144.73MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务14：UVM14-TLM_communication3.mp4 [ 93.34MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务15：UVM15-Scoreboard_and_Coverage.mp4 [ 114.33MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务16：UVM16-UVM_callback.mp4 [ 47.21MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务17：UVM17-Component_phase.mp4 [ 123.45MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务18：UVM_18_virtual_sequencer.mp4 [ 152.98MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务19：UVM_19_Sequence_library.mp4 [ 41.51MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务1：UVM01-OOP overview.mp4 [ 104.97MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务20：UVM20-RAL.mp4 [ 117.60MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务21：UVM21-RAL2.mp4 [ 187.38MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务22：UVM22-RAL3.mp4 [ 128.55MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务23：SRAMC DUT简介.mp4 [ 104.98MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务24：SRAMC DUT功能划分.mp4 [ 302.82MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务25：SRAMC ahb agent编写.mp4 [ 121.34MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务26：SRAMC seq.mp4 [ 276.09MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务27：SRAMC monitor and scb.mp4 [ 269.88MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务28：课程总结和面试题分析.mp4 [ 145.56MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务2：UVM02-OOP Appendix.mp4 [ 131.09MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务3：UVM03-UVM_testbench.mp4 [ 152.85MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务4：UVM04-testbench architecture.mp4 [ 109.67MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务5：UVM05-Lab1 and DUT_Spec.mp4 [ 105.80MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务6：UVM06-Transaction_Modeling.mp4 [ 180.95MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务7：UVM07-Transaction lab2.mp4 [ 97.91MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务8：UVM08-UVM Sequence.mp4 [ 158.85MB ]
｜ ｜ ｜ ｜ ｜ ｜ 任务9：UVM09-UVM Sequence Lab3.mp4 [ 92.31MB ]
｜ ｜ ｜ ｜ ｜ 【启芯教育】UVM高级使用方法 [ 1.65GB ]
｜ ｜ ｜ ｜ ｜ ｜ 1 OOP Review.mp4 [ 138.19MB ]
｜ ｜ ｜ ｜ ｜ ｜ 10 Phase.mp4 [ 101.68MB ]
｜ ｜ ｜ ｜ ｜ ｜ 11 RAL.mp4 [ 103.65MB ]
｜ ｜ ｜ ｜ ｜ ｜ 2 Testbench01.mp4 [ 110.93MB ]
｜ ｜ ｜ ｜ ｜ ｜ 2 Testbench02.mp4 [ 148.73MB ]
｜ ｜ ｜ ｜ ｜ ｜ 3 Transaction Modeling.mp4 [ 150.00MB ]
｜ ｜ ｜ ｜ ｜ ｜ 4 Sequence.mp4 [ 141.05MB ]
｜ ｜ ｜ ｜ ｜ ｜ 5 Component Factory Config 1.mp4 [ 171.41MB ]
｜ ｜ ｜ ｜ ｜ ｜ 5 Component Factory Config 2.mp4 [ 148.88MB ]
｜ ｜ ｜ ｜ ｜ ｜ 6 TLM.mp4 [ 135.61MB ]
｜ ｜ ｜ ｜ ｜ ｜ 7 Scoreboard and Coverage.mp4 [ 189.59MB ]
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｜ ｜ ｜ ｜ 4.项目芯片设计规格书 [ 2.75MB ]
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｜ ｜ ｜ ｜ 5.项目芯片详细设计 [ 2.06MB ]
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｜ ｜ ｜ 第1章：AMBAbus和基于AHB、APB Slave设计 [ 3.99GB ]
｜ ｜ ｜ ｜ 任务1：AMBA bus介绍 [ 1.71GB ]
｜ ｜ ｜ ｜ ｜ AMBA bus介绍_01.mp4 [ 346.84MB ]
｜ ｜ ｜ ｜ ｜ AMBA bus介绍_02.mp4 [ 318.47MB ]
｜ ｜ ｜ ｜ ｜ AMBA bus介绍_03.mp4 [ 240.47MB ]
｜ ｜ ｜ ｜ ｜ AMBA bus介绍_04.mp4 [ 219.34MB ]
｜ ｜ ｜ ｜ ｜ AMBA bus介绍_05.mp4 [ 620.35MB ]
｜ ｜ ｜ ｜ ｜ AMBA总线 [ 6.35MB ]
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｜ ｜ ｜ ｜ 任务2：APB总线介绍，基于AHB Slave设计及验证平台搭建 [ 2.27GB ]
｜ ｜ ｜ ｜ ｜ APB总线介绍，基于AHB Slave设计及验证平台搭建.mp4 [ 2.27GB ]
｜ ｜ ｜ 第2章：基于AHB的SARAM控制器的设计 [ 7.37GB ]
｜ ｜ ｜ ｜ Coding style-2.avi [ 70.26MB ]
｜ ｜ ｜ ｜ Coding style.mp4 [ 223.70MB ]
｜ ｜ ｜ ｜ sram介绍、相关文档.avi [ 289.18MB ]
｜ ｜ ｜ ｜ SRAM控制器 RTL design和simulation讲解_1.mp4 [ 585.32MB ]
｜ ｜ ｜ ｜ SRAM控制器 RTL design和simulation讲解_2.mp4 [ 118.35MB ]
｜ ｜ ｜ ｜ SRAM控制器 RTL design和simulation讲解_3.mp4 [ 1.64GB ]
｜ ｜ ｜ ｜ SRAM控制器 RTL design和simulation讲解_4.mp4 [ 2.84GB ]
｜ ｜ ｜ ｜ SRAM控制器 RTL design和simulation讲解_5.mp4 [ 1.64GB ]
｜ ｜ ｜ 第3章：基于AHB的Flash控制器的设计 [ 3.50GB ]
｜ ｜ ｜ ｜ Flash介绍，Flash模型介绍.mp4 [ 1.28GB ]
｜ ｜ ｜ ｜ flash控制器文档代码仿真01.mp4 [ 469.26MB ]
｜ ｜ ｜ ｜ flash控制器文档代码仿真02.mp4 [ 1.76GB ]
｜ ｜ ｜ 第4章：基于APB、AHB SD控制器的设计 [ 2.75GB ]
｜ ｜ ｜ ｜ 任务10：基于AHB SD Host代码介绍.avi [ 835.89MB ]
｜ ｜ ｜ ｜ 任务7：SD2.0协议介绍-1.mp4 [ 134.85MB ]
｜ ｜ ｜ ｜ 任务7：SD2.0协议介绍-2.mp4 [ 609.91MB ]
｜ ｜ ｜ ｜ 任务8：SD控制器设计文档介绍，代码介绍-1.mp4 [ 241.85MB ]
｜ ｜ ｜ ｜ 任务8：SD控制器设计文档介绍，代码介绍-2.mp4 [ 360.66MB ]
｜ ｜ ｜ ｜ 任务9：APB SD Host data传输代码介绍.avi [ 633.92MB ]
｜ ｜ ｜ 第5章：AHB APB相关模块生产 [ 3.63GB ]
｜ ｜ ｜ ｜ 任务1：AHB+APB+CPU(BFM)小系统构建.mp4 [ 788.47MB ]
｜ ｜ ｜ ｜ 任务2：sramc,sd host,flash controller集成及系统级仿真.mp4 [ 202.05MB ]
｜ ｜ ｜ ｜ 任务3：sramc,sd host,flash controller集成及系统级仿真2.mp4 [ 1.00GB ]
｜ ｜ ｜ ｜ 任务4：GPIO+ICTL+DMAC.mp4 [ 266.84MB ]
｜ ｜ ｜ ｜ 任务5：GPIO+ICTL+DMAC2-1.mp4 [ 799.61MB ]
｜ ｜ ｜ ｜ 任务5：GPIO+ICTL+DMAC2-2.mp4 [ 636.16MB ]
｜ ｜ ｜ 第6章：芯片集成 [ 2.59GB ]
｜ ｜ ｜ ｜ 任务10：芯片可测性设计—Pinmux设计及集成.mp4 [ 321.74MB ]
｜ ｜ ｜ ｜ 任务11：subsys pinmux 代码介绍，课程回顾，fullchip 仿真.mp4 [ 651.71MB ]
｜ ｜ ｜ ｜ 任务6：课程回顾，Sys ctrl设计.mp4 [ 398.11MB ]
｜ ｜ ｜ ｜ 任务7：sys ctrl 设计，Flash 集成，subsys_core集成.mp4 [ 481.55MB ]
｜ ｜ ｜ ｜ 任务8：芯片时钟复位管理模块设计.mp4 [ 341.84MB ]
｜ ｜ ｜ ｜ 任务9：subsys_top 集成，Subsys_top_pad集成.mp4 [ 462.21MB ]
｜ ｜ ｜ 第7章：课程扩展 [ 298.95MB ]
｜ ｜ ｜ ｜ 任务12：答疑，FPGA验证，中后段设计，职业发展.avi [ 298.95MB ]
｜ ｜ ｜ 启芯SoC实训 [ 725.90MB ]
｜ ｜ ｜ ｜ 启芯实训 01 [ 162.63MB ]
｜ ｜ ｜ ｜ ｜ QX_SoC_Training.xlsx [ 65.24kB ]
｜ ｜ ｜ ｜ ｜ SoC Architecture Specification.docx [ 101.98kB ]
｜ ｜ ｜ ｜ ｜ SoC Verification Plan.docx [ 92.85kB ]
｜ ｜ ｜ ｜ ｜ 启芯SoC实训 01.mp4 [ 162.38MB ]
｜ ｜ ｜ ｜ 启芯实训 02 [ 151.97MB ]
｜ ｜ ｜ ｜ ｜ 启芯实训02.mp4 [ 151.97MB ]
｜ ｜ ｜ ｜ 启芯实训 03 [ 195.54MB ]
｜ ｜ ｜ ｜ ｜ 启芯实训 03.mp4 [ 195.54MB ]
｜ ｜ ｜ ｜ 远程登录服务器 [ 215.75MB ]
｜ ｜ ｜ ｜ ｜ VNC-Viewer-5.0.5-Windows-32bit.exe [ 2.65MB ]
｜ ｜ ｜ ｜ ｜ 培训计划模板.xls [ 37.50kB ]
｜ ｜ ｜ ｜ ｜ 启芯SoC芯片设计实训项目.mp4 [ 211.90MB ]
｜ ｜ ｜ ｜ ｜ 启芯服务器登陆方法.pdf [ 449.09kB ]
｜ ｜ ｜ ｜ ｜ 启芯实训计划.pdf [ 726.03kB ]
｜ ｜ ｜ ｜ ｜ 网络测试信息反馈.xls [ 23.50kB ]
｜ ｜ 【E课网】数字前端就业班在线授权1906期￥23000 [ 10.77GB ]
｜ ｜ ｜ 任务01：数字IC设计流程_.mp4 [ 249.00MB ]
｜ ｜ ｜ 任务02：数字前端设计工程师就业班概述_.mp4 [ 291.54MB ]
｜ ｜ ｜ 任务03：VNC服务器使用说明_.mp4 [ 128.96MB ]
｜ ｜ ｜ 任务04：linux操作系统常用命令_.mp4 [ 148.02MB ]
｜ ｜ ｜ 任务05：linux与gvim文本编辑工具操作实践_.mp4 [ 81.17MB ]
｜ ｜ ｜ 任务06：gvim文本编辑工具_.mp4 [ 88.96MB ]
｜ ｜ ｜ 任务07：数字电路基础_.mp4 [ 34.72MB ]
｜ ｜ ｜ 任务08：gvim正则表达式_.mp4 [ 99.88MB ]
｜ ｜ ｜ 任务09：逻辑综合工具Design Compiler的使用_.mp4 [ 35.72MB ]
｜ ｜ ｜ 任务100：sd host task list解答1_.mp4 [ 89.27MB ]
｜ ｜ ｜ 任务101：sd host task list解答2_.mp4 [ 99.88MB ]
｜ ｜ ｜ 任务102：作业讲解（20bit转32bit）（2课时）_.mp4 [ 272.49MB ]
｜ ｜ ｜ 任务103：综合的基本概念_.mp4 [ 29.96MB ]
｜ ｜ ｜ 任务104：Design and Technology Data 1_.mp4 [ 30.42MB ]
｜ ｜ ｜ 任务105：Design and Technology Data 2_.mp4 [ 33.70MB ]
｜ ｜ ｜ 任务106：lab1逻辑综合基本流程_.mp4 [ 36.14MB ]
｜ ｜ ｜ 任务107：Design and Library Objects_.mp4 [ 28.42MB ]
｜ ｜ ｜ 任务108：数字电路时序分析基础_.mp4 [ 28.61MB ]
｜ ｜ ｜ 任务109：Timing Constraints1_.mp4 [ 27.42MB ]
｜ ｜ ｜ 任务10：数字电路基础-时序逻辑基础.mp4 [ 143.98MB ]
｜ ｜ ｜ 任务110：Timing Constraints2_.mp4 [ 24.47MB ]
｜ ｜ ｜ 任务111：Timing Constraints3_.mp4 [ 25.30MB ]
｜ ｜ ｜ 任务112：实验手册lab3_时序分析_.mp4 [ 36.41MB ]
｜ ｜ ｜ 任务113：Environmental Attributes_.mp4 [ 31.28MB ]
｜ ｜ ｜ 任务114：实验手册lab4_环境属性_.mp4 [ 46.08MB ]
｜ ｜ ｜ 任务115：综合技术1_.mp4 [ 64.11MB ]
｜ ｜ ｜ 任务116：综合技术2_.mp4 [ 42.51MB ]
｜ ｜ ｜ 任务117：实验手册lab5_综合技术1_.mp4 [ 28.04MB ]
｜ ｜ ｜ 任务118：附加约束选项_.mp4 [ 28.81MB ]
｜ ｜ ｜ 任务119：Multiple Clock and Exceptions_.mp4 [ 27.94MB ]
｜ ｜ ｜ 任务11：逻辑仿真工具VCS的使用-Makefile_.mp4 [ 131.22MB ]
｜ ｜ ｜ 任务120：DC输出_.mp4 [ 30.68MB ]
｜ ｜ ｜ 任务121：形式验证基本概念_.mp4 [ 35.80MB ]
｜ ｜ ｜ 任务122：形式验证基本流程_.mp4 [ 40.68MB ]
｜ ｜ ｜ 任务123：形式验证实验_.mp4 [ 25.61MB ]
｜ ｜ ｜ 任务12：逻辑仿真工具VCS的使用_.mp4 [ 53.58MB ]
｜ ｜ ｜ 任务13：逻辑综合工具-DC实操_.mp4 [ 114.37MB ]
｜ ｜ ｜ 任务14：逻辑综合工具-DC实操-02_.mp4 [ 57.01MB ]
｜ ｜ ｜ 任务15：Verilog Systemverilog – 数据类型_.mp4 [ 100.12MB ]
｜ ｜ ｜ 任务16：操作符和过程控制_.mp4 [ 80.09MB ]
｜ ｜ ｜ 任务17： task-function_.mp4 [ 34.78MB ]
｜ ｜ ｜ 任务18：并发线程_.mp4 [ 93.72MB ]
｜ ｜ ｜ 任务19：并发线程与SV实操_.mp4 [ 40.27MB ]
｜ ｜ ｜ 任务20： 经典组合和数字电路的设计_.mp4 [ 37.71MB ]
｜ ｜ ｜ 任务21：有限状态机的写法_.mp4 [ 33.18MB ]
｜ ｜ ｜ 任务22：同步fifo-异步fifo的设计_.mp4 [ 36.04MB ]
｜ ｜ ｜ 任务23：同步FIFO设计方法2介绍与仿真_.mp4 [ 109.55MB ]
｜ ｜ ｜ 任务24：异步FIFO的设计_.mp4 [ 54.20MB ]
｜ ｜ ｜ 任务25：CDC_Metastability（亚稳态）_.mp4 [ 121.61MB ]
｜ ｜ ｜ 任务26：CDC设计实例.ev4_.mp4 [ 16.29MB ]
｜ ｜ ｜ 任务27：Clock_Swith_Glitch_Free_Verdi调试方法和Makefile_.mp4 [ 71.45MB ]
｜ ｜ ｜ 任务28：Spyglass的基础使用_.mp4 [ 66.35MB ]
｜ ｜ ｜ 任务29：Spyglass的基本使用-2_.mp4 [ 132.18MB ]
｜ ｜ ｜ 任务30：实训项目介绍1_.mp4 [ 80.96MB ]
｜ ｜ ｜ 任务31：实训项目介绍2_.mp4 [ 107.98MB ]
｜ ｜ ｜ 任务32：AMBA总线介绍1_.mp4 [ 86.88MB ]
｜ ｜ ｜ 任务33：AMBA总线介绍2_.mp4 [ 94.84MB ]
｜ ｜ ｜ 任务34：AMBA总线介绍3_.mp4 [ 69.42MB ]
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｜ ｜ ｜ 任务38：AHB SRAM控制器设计1_.mp4 [ 80.32MB ]
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｜ ｜ ｜ 任务46：Verilog RTL编码风格介绍_.mp4 [ 96.62MB ]
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｜ ｜ ｜ 深度解析USB协议–（1906期客户可看） [ 284.53MB ]
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｜ ｜ 【E课网集成电路培训课程系列】初级IC设计工程师1711期 [ 44.20GB ]
｜ ｜ ｜ 初级数字IC-11期 [ 44.20GB ]
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｜ ｜ ｜ ｜ 任务14-UVM精讲1.mp4 [ 983.56MB ]
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｜ ｜ ｜ 1.数字IC设计流程介绍1_.mp4 [ 60.02MB ]
｜ ｜ ｜ 10.经典组合电路和时序电路1_.mp4 [ 44.71MB ]
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｜ ｜ ｜ 107.作业统计_.mp4 [ 56.17MB ]
｜ ｜ ｜ 108.AMBA总线介绍_.mp4 [ 37.25MB ]
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｜ ｜ ｜ 111.项目实训-HDMI CEC spec_.mp4 [ 44.07MB ]
｜ ｜ ｜ 112.项目实训-HDMI CEC spec 2_.mp4 [ 39.30MB ]
｜ ｜ ｜ 113.项目实训-HDMI CEC 验证需求分解_.mp4 [ 44.28MB ]
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｜ ｜ ｜ 115.项目实训-HDMI CEC 寄存器简介_.mp4 [ 52.10MB ]
｜ ｜ ｜ 116.项目实训-HDMI CEC 验证计划_.mp4 [ 88.09MB ]
｜ ｜ ｜ 117.项目实训-HDMI CEC UVM TB搭建_.mp4 [ 5.52MB ]
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｜ ｜ ｜ 119.自动生成RAL脚本简介_.mp4 [ 57.77MB ]
｜ ｜ ｜ 12.经典组合电路和时序电路3_.mp4 [ 47.09MB ]
｜ ｜ ｜ 120.项目实训-HDMI CEC 验证环境详设_.mp4 [ 73.22MB ]
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｜ ｜ ｜ 122.项目实训-HDMI CEC 验证用例设计_.mp4 [ 59.65MB ]
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｜ ｜ ｜ 124.面试题：验证基础_.mp4 [ 2.96MB ]
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｜ ｜ ｜ 24.SV Interface and Program_.mp4 [ 53.35MB ]
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｜ ｜ ｜ 29.SVV DataTypes logic_bit_byte_array_.mp4 [ 81.07MB ]
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｜ ｜ ｜ 31【选修】数字电路基础_.mp4 [ 35.15MB ]
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｜ ｜ ｜ 33.SVV Data Types_array_operators_.mp4 [ 63.64MB ]
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｜ ｜ ｜ 37.SVV OOP class_.mp4 [ 73.07MB ]
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｜ ｜ ｜ 39.SVV 作业 3_.mp4 [ 47.61MB ]
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｜ ｜ ｜ 41.SVV Randomization_.mp4 [ 69.91MB ]
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｜ ｜ ｜ 49.SVV Assertion Summary_.mp4 [ 65.71MB ]
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｜ ｜ ｜ 54.SVV 课程总结_.mp4 [ 37.63MB ]
｜ ｜ ｜ 55.SV TB AHB-SRAMC 设计_.mp4 [ 64.07MB ]
｜ ｜ ｜ 56.SV TB AHB-SRAMC 设计2_.mp4 [ 76.75MB ]
｜ ｜ ｜ 57.SV TB AHB-SRAMC 验证_.mp4 [ 80.99MB ]
｜ ｜ ｜ 58.SV TB AHB-SRAMC 验证 2_.mp4 [ 90.05MB ]
｜ ｜ ｜ 59.SV TB AHB-SRAMC 验证 3_.mp4 [ 66.38MB ]
｜ ｜ ｜ 6.GVIM文本编辑工具基本操作1_.mp4 [ 62.23MB ]
｜ ｜ ｜ 60.SV TB AHB-SRAMC 验证 4_.mp4 [ 80.78MB ]
｜ ｜ ｜ 61.UVM OOP overview_.mp4 [ 60.81MB ]
｜ ｜ ｜ 62.UVM OOP overview 2_.mp4 [ 78.53MB ]
｜ ｜ ｜ 63.UVM testbench_.mp4 [ 74.95MB ]
｜ ｜ ｜ 64.UVM testbench 2_.mp4 [ 43.81MB ]
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｜ ｜ ｜ 67.mp4 [ 60.83MB ]
｜ ｜ ｜ 68.UVM Lab1讲解_.mp4 [ 49.00MB ]
｜ ｜ ｜ 69UVM Transaction_.mp4 [ 42.44MB ]
｜ ｜ ｜ 7.GVIM文本编辑工具基本操作2_.mp4 [ 73.75MB ]
｜ ｜ ｜ 70.UVM Transaction 2_.mp4 [ 42.26MB ]
｜ ｜ ｜ 71.UVM Sequence_.mp4 [ 42.79MB ]
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｜ ｜ ｜ 77.UVM factory_.mp4 [ 50.01MB ]
｜ ｜ ｜ 78.UVM TLM_communication_.mp4 [ 47.66MB ]
｜ ｜ ｜ 79.UVM Scoreboard_and_Coverage_.mp4 [ 37.58MB ]
｜ ｜ ｜ 8.GVIM正则表达式_.mp4 [ 70.42MB ]
｜ ｜ ｜ 80.答疑5_.mp4 [ 58.40MB ]
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｜ ｜ ｜ 82.UVM Lab3讲解_.mp4 [ 60.54MB ]
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｜ ｜ ｜ 84.UVM callback_.mp4 [ 43.94MB ]
｜ ｜ ｜ 85.UVM Component_phase_.mp4 [ 53.10MB ]
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｜ ｜ ｜ 89.UVM RAL_.mp4 [ 45.16MB ]
｜ ｜ ｜ 9.逻辑仿真工具Questasim的使用_.mp4 [ 77.55MB ]
｜ ｜ ｜ 90.UVM RAL 2_.mp4 [ 21.31MB ]
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｜ ｜ ｜ 94.UVM Review_.mp4 [ 35.97MB ]
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｜ ｜ ｜ 数字IC后端设计 [ 10.75GB ]
｜ ｜ ｜ ｜ 任务01：数字ASIC设计全流程介绍.mp4 [ 68.87MB ]
｜ ｜ ｜ ｜ 任务02：视频：ASIC设计流程演示.mp4 [ 75.99MB ]
｜ ｜ ｜ ｜ 任务03：Linux和VI的基本操作.mp4 [ 30.47MB ]
｜ ｜ ｜ ｜ 任务04：视频：Linux常用命令.mp4 [ 119.43MB ]
｜ ｜ ｜ ｜ 任务05：Vi的基本操作.mp4 [ 69.20MB ]
｜ ｜ ｜ ｜ 任务06：视频：VI基本操作.mp4 [ 57.68MB ]
｜ ｜ ｜ ｜ 任务07：数字ASIC设计基础知识点.mp4 [ 3.33MB ]
｜ ｜ ｜ ｜ 任务08：视频：数字ASIC设计基础知识.mp4 [ 105.06MB ]
｜ ｜ ｜ ｜ 任务09：答疑：ASIC流程，VI，Linux，数字ASIC设计基础.mp4 [ 74.02MB ]
｜ ｜ ｜ ｜ 任务10：tcl基础课程1.mp4 [ 23.28MB ]
｜ ｜ ｜ ｜ 任务11：tcl基础-替换.mp4 [ 44.11MB ]
｜ ｜ ｜ ｜ 任务12：TCL基础答疑1.mp4 [ 52.85MB ]
｜ ｜ ｜ ｜ 任务13：tcl流程控制.mp4 [ 34.35MB ]
｜ ｜ ｜ ｜ 任务14：tcl基础答疑2.mp4 [ 35.55MB ]
｜ ｜ ｜ ｜ 任务15：逻辑综合：基本原理及设计输入.mp4 [ 100.14MB ]
｜ ｜ ｜ ｜ 任务16：视频：设计对象.mp4 [ 23.46MB ]
｜ ｜ ｜ ｜ 任务17：视频：时序约束（1）.mp4 [ 45.53MB ]
｜ ｜ ｜ ｜ 任务18：视频：时序约束（2）.mp4 [ 34.66MB ]
｜ ｜ ｜ ｜ 任务19：视频：lab1 逻辑综合基本原理.mp4 [ 45.37MB ]
｜ ｜ ｜ ｜ 任务20：答疑：逻辑综合基本原理+时序约束.mp4 [ 50.83MB ]
｜ ｜ ｜ ｜ 任务22：视频：lab3时序约束.mp4 [ 61.08MB ]
｜ ｜ ｜ ｜ 任务23：逻辑综合：环境约束+逻辑综合优化.mp4 [ 35.13MB ]
｜ ｜ ｜ ｜ 任务24：视频：优化技术.mp4 [ 111.59MB ]
｜ ｜ ｜ ｜ 任务25：优化技术及时序报告分析.mp4 [ 42.41MB ]
｜ ｜ ｜ ｜ 任务26：逻辑综合：多时钟约束.mp4 [ 37.43MB ]
｜ ｜ ｜ ｜ 任务27：逻辑综合输出.mp4 [ 34.98MB ]
｜ ｜ ｜ ｜ 任务28： 视频：形式验证基本原理及流程.mp4 [ 43.88MB ]
｜ ｜ ｜ ｜ 任务29：项目：RISC8的逻辑综合与形式验证.mp4 [ 31.00MB ]
｜ ｜ ｜ ｜ 任务30：答疑：lab4及作业 01.mp4 [ 342.28MB ]
｜ ｜ ｜ ｜ 任务31：答疑：lab5.mp4 [ 65.79MB ]
｜ ｜ ｜ ｜ 任务32：项目：RISC8的逻辑综合与形式验证.mp4 [ 81.15MB ]
｜ ｜ ｜ ｜ 任务33：PR Introduction.mp4 [ 180.10MB ]
｜ ｜ ｜ ｜ 任务34：data setup.mp4 [ 59.03MB ]
｜ ｜ ｜ ｜ 任务35：data setup2 and lab.mp4 [ 417.00MB ]
｜ ｜ ｜ ｜ 任务36：data setup 02.mp4 [ 198.11MB ]
｜ ｜ ｜ ｜ 任务37：MCMM setup and ICC lab.mp4 [ 106.72MB ]
｜ ｜ ｜ ｜ 任务38：ICC_design planning 01.mp4 [ 268.50MB ]
｜ ｜ ｜ ｜ 任务39：ICC_design planning1.mp4 [ 233.39MB ]
｜ ｜ ｜ ｜ 任务40：实验OA 和1 02.mp4 [ 536.06MB ]
｜ ｜ ｜ ｜ 任务41：design planning review 05.mp4 [ 213.78MB ]
｜ ｜ ｜ ｜ 任务42：design planning2.mp4 [ 116.87MB ]
｜ ｜ ｜ ｜ 任务43：ICC_design planning3 06.mp4 [ 531.84MB ]
｜ ｜ ｜ ｜ 任务44：答疑——临时 07.mp4 [ 61.85MB ]
｜ ｜ ｜ ｜ 任务45：design planning review 1 08.mp4 [ 231.86MB ]
｜ ｜ ｜ ｜ 任务46：placement.mp4 [ 104.86MB ]
｜ ｜ ｜ ｜ 任务47：placement2.mp4 [ 242.92MB ]
｜ ｜ ｜ ｜ 任务48：placement review 09.mp4 [ 172.27MB ]
｜ ｜ ｜ ｜ 任务49：cts.mp4 [ 95.53MB ]
｜ ｜ ｜ ｜ 任务50：cts1.mp4 [ 229.96MB ]
｜ ｜ ｜ ｜ 任务51：cts review 10.mp4 [ 230.41MB ]
｜ ｜ ｜ ｜ 任务52：Routing.mp4 [ 101.06MB ]
｜ ｜ ｜ ｜ 任务53：Routing1.mp4 [ 131.69MB ]
｜ ｜ ｜ ｜ 任务54：routing review 11.mp4 [ 188.35MB ]
｜ ｜ ｜ ｜ 任务55：ICC lab.mp4 [ 167.28MB ]
｜ ｜ ｜ ｜ 任务56：ICC lab2 01.mp4 [ 777.46MB ]
｜ ｜ ｜ ｜ 任务57：soc后端设计_01 02.mp4 [ 192.78MB ]
｜ ｜ ｜ ｜ 任务58：soc后端设计_02.mp4 [ 86.65MB ]
｜ ｜ ｜ ｜ 任务59：soc后端设计_03.mp4 [ 195.48MB ]
｜ ｜ ｜ ｜ 任务60：soc后端设计_04 03.mp4 [ 241.17MB ]
｜ ｜ ｜ ｜ 任务61：soc后端设计_05 05.mp4 [ 425.32MB ]
｜ ｜ ｜ ｜ 任务62：soc后端设计_06 01.mp4 [ 754.59MB ]
｜ ｜ ｜ ｜ 任务63：STA 介绍.mp4 [ 209.86MB ]
｜ ｜ ｜ ｜ 任务64：视频：STA介绍.mp4 [ 44.88MB ]
｜ ｜ ｜ ｜ 任务65：视频：lab介绍.mp4 [ 55.17MB ]
｜ ｜ ｜ ｜ 任务66：PT01.mp4 [ 5.40MB ]
｜ ｜ ｜ ｜ 任务67：PT02.mp4 [ 39.28MB ]
｜ ｜ ｜ ｜ 任务68：STA答疑.mp4 [ 12.93MB ]
｜ ｜ ｜ ｜ 任务69：soc课程复习加.mp4 [ 318.17MB ]
｜ ｜ ｜ ｜ 任务70：SOC课程答疑.mp4 [ 470.96MB ]
｜ ｜ ｜ ｜ 任务71：PT03.mp4 [ 35.65MB ]
｜ ｜ ｜ ｜ 任务72：PT04.mp4 [ 88.88MB ]
｜ ｜ ｜ ｜ 任务73：sta 答疑.mp4 [ 170.68MB ]
｜ ｜ ｜ ｜ 任务74：STA.mp4 [ 4.19MB ]
｜ ｜ ｜ ｜ 任务75：总结.mp4 [ 76.11MB ]
｜ ｜ 【移知】Arm Cortex-M3 MCU芯片前端设计及软硬件验证课程 [ 2.48GB ]
｜ ｜ ｜ 第01章 SoC及Arm处理器架构 [ 375.29MB ]
｜ ｜ ｜ ｜ 2.1 认识SoC.mp4 [ 36.74MB ]
｜ ｜ ｜ ｜ 2.10 Cortex-M架构介绍.mp4 [ 37.50MB ]
｜ ｜ ｜ ｜ 2.11 ARMv7-M编程者模型.mp4 [ 33.15MB ]
｜ ｜ ｜ ｜ 2.12 ARMv7-M debug.mp4 [ 9.77MB ]
｜ ｜ ｜ ｜ 2.13 ARMv7-M Memory管理和属性.mp4 [ 20.72MB ]
｜ ｜ ｜ ｜ 2.14 学习资料说明.html [ 1.80kB ]
｜ ｜ ｜ ｜ 2.2 SoC设计方法学.mp4 [ 34.20MB ]
｜ ｜ ｜ ｜ 2.3 SoC设计挑战.mp4 [ 63.85MB ]
｜ ｜ ｜ ｜ 2.4 SoC中处理器选择.mp4 [ 23.39MB ]
｜ ｜ ｜ ｜ 2.5 课程介绍.mp4 [ 6.74MB ]
｜ ｜ ｜ ｜ 2.6 MCU设计规格.mp4 [ 26.77MB ]
｜ ｜ ｜ ｜ 2.7 MCU顶层设计.mp4 [ 37.32MB ]
｜ ｜ ｜ ｜ 2.8 MCU结构设计.mp4 [ 32.06MB ]
｜ ｜ ｜ ｜ 2.9 MCU的快速实现方法.mp4 [ 12.63MB ]
｜ ｜ ｜ ｜ 2_20240221233549.pptx [ 445.90kB ]
｜ ｜ ｜ 第02章 Cortex-M3处理器 [ 279.56MB ]
｜ ｜ ｜ ｜ 3.1 Cortex-M3处理器结构.mp4 [ 35.98MB ]
｜ ｜ ｜ ｜ 3.2 Cortex-M3处理器微架构.mp4 [ 68.20MB ]
｜ ｜ ｜ ｜ 3.3 Cortex-M3处理器IP配置.mp4 [ 56.65MB ]
｜ ｜ ｜ ｜ 3.4 关键参数详解.mp4 [ 13.78MB ]
｜ ｜ ｜ ｜ 3.5 时钟复位.mp4 [ 37.38MB ]
｜ ｜ ｜ ｜ 3.6 总线接口使用.mp4 [ 54.19MB ]
｜ ｜ ｜ ｜ 3.7 其他一些信号.mp4 [ 13.36MB ]
｜ ｜ ｜ ｜ 3.8 学习资料说明.html [ 1.52kB ]
｜ ｜ ｜ ｜ 3.9 任务：了解Cortex-M3的IP如何集成的.html [ 6.11kB ]
｜ ｜ ｜ 第03章 总线系统 [ 202.01MB ]
｜ ｜ ｜ ｜ 4.1 CMSDK Bus Matrix介绍.mp4 [ 34.24MB ]
｜ ｜ ｜ ｜ 4.2 bus-matrix的配置.mp4 [ 18.79MB ]
｜ ｜ ｜ ｜ 4.3 bus-matrix-remap.mp4 [ 33.37MB ]
｜ ｜ ｜ ｜ 4.4 bus-matrix-演示.mp4 [ 21.21MB ]
｜ ｜ ｜ ｜ 4.5 BusMatrix生成.html [ 1.30kB ]
｜ ｜ ｜ ｜ 4.6 总线其他相关模块.mp4 [ 30.09MB ]
｜ ｜ ｜ ｜ 4.7 bus系统代码.mp4 [ 64.31MB ]
｜ ｜ ｜ 第04章 Memory系统 [ 199.97MB ]
｜ ｜ ｜ ｜ 5.1 Memory_Introduction.mp4 [ 34.83MB ]
｜ ｜ ｜ ｜ 5.2 Flash_Memory.mp4 [ 44.62MB ]
｜ ｜ ｜ ｜ 5.3 eFlash_IP规格分析.mp4 [ 57.58MB ]
｜ ｜ ｜ ｜ 5.4 eFlash控制器.mp4 [ 34.24MB ]
｜ ｜ ｜ ｜ 5.5 任务：理解eFlash.html [ 872B ]
｜ ｜ ｜ ｜ 5.6 物理Memory_Instance.mp4 [ 28.70MB ]
｜ ｜ ｜ ｜ 5.7 初始化ROM.html [ 1.34kB ]
｜ ｜ ｜ ｜ 5.8 任务：理解memory系统的代码.html [ 641B ]
｜ ｜ ｜ 第05章 外设系统 [ 467.68MB ]
｜ ｜ ｜ ｜ 6.1 外设介绍.mp4 [ 24.76MB ]
｜ ｜ ｜ ｜ 6.10 DMA的认识.mp4 [ 63.90MB ]
｜ ｜ ｜ ｜ 6.11 DMA IP.mp4 [ 29.20MB ]
｜ ｜ ｜ ｜ 6.12 PL230描述符.mp4 [ 40.70MB ]
｜ ｜ ｜ ｜ 6.13 PL230工作流程.mp4 [ 43.62MB ]
｜ ｜ ｜ ｜ 6.14 任务：理解中断行为.html [ 751B ]
｜ ｜ ｜ ｜ 6.2 UART-I2C-SPI-IP功能.mp4 [ 34.75MB ]
｜ ｜ ｜ ｜ 6.3 Timer-Watchdog-RTC.mp4 [ 21.14MB ]
｜ ｜ ｜ ｜ 6.4 integration.mp4 [ 85.37MB ]
｜ ｜ ｜ ｜ 6.5 ADC-SPEC.mp4 [ 16.75MB ]
｜ ｜ ｜ ｜ 6.6 ADC-IP.mp4 [ 47.84MB ]
｜ ｜ ｜ ｜ 6.7 ADC-接口设计.mp4 [ 22.26MB ]
｜ ｜ ｜ ｜ 6.8 ADC接口代码.mp4 [ 37.39MB ]
｜ ｜ ｜ ｜ 6.9 任务：ADC的接口实现.html [ 772B ]
｜ ｜ ｜ 第06章 中断系统 [ 269.89MB ]
｜ ｜ ｜ ｜ 7.1 异常介绍.mp4 [ 31.14MB ]
｜ ｜ ｜ ｜ 7.10 MCU IO中断控制.mp4 [ 27.43MB ]
｜ ｜ ｜ ｜ 7.11 MCU IO中断映射.mp4 [ 54.55MB ]
｜ ｜ ｜ ｜ 7.12 任务：理解中断行为.html [ 751B ]
｜ ｜ ｜ ｜ 7.2 内部异常.mp4 [ 35.43MB ]
｜ ｜ ｜ ｜ 7.3 外部中断.mp4 [ 7.72MB ]
｜ ｜ ｜ ｜ 7.4 中断向量表.mp4 [ 19.24MB ]
｜ ｜ ｜ ｜ 7.5 电平和脉冲中断.mp4 [ 9.59MB ]
｜ ｜ ｜ ｜ 7.6 中断的进入和退出.mp4 [ 16.77MB ]
｜ ｜ ｜ ｜ 7.7 中断集成及Latency优化.mp4 [ 21.46MB ]
｜ ｜ ｜ ｜ 7.8 任务：理解外部中断控制.html [ 596B ]
｜ ｜ ｜ ｜ 7.9 MCU向量表设计.mp4 [ 46.56MB ]
｜ ｜ ｜ 第07章 功耗管理 [ 190.04MB ]
｜ ｜ ｜ ｜ 8.1 低功耗设计方法.mp4 [ 32.02MB ]
｜ ｜ ｜ ｜ 8.2 时钟管理.mp4 [ 13.13MB ]
｜ ｜ ｜ ｜ 8.3 电压域和电源域.mp4 [ 17.27MB ]
｜ ｜ ｜ ｜ 8.4 Cotex-M3功耗管理.mp4 [ 49.98MB ]
｜ ｜ ｜ ｜ 8.5 MCU功耗管理方案.mp4 [ 20.74MB ]
｜ ｜ ｜ ｜ 8.6 PMU的RTL实现.mp4 [ 56.90MB ]
｜ ｜ ｜ ｜ 8.7 任务：理解PMU的实现.html [ 571B ]
｜ ｜ ｜ 第08章 顶层设计 [ 293.31MB ]
｜ ｜ ｜ ｜ 9.1 顶层规划.mp4 [ 31.20MB ]
｜ ｜ ｜ ｜ 9.2 IO定义、复用和集成.mp4 [ 96.41MB ]
｜ ｜ ｜ ｜ 9.3 设计中的DFT.mp4 [ 28.47MB ]
｜ ｜ ｜ ｜ 9.4 时钟信号及结构.mp4 [ 29.10MB ]
｜ ｜ ｜ ｜ 9.5 PLL集成.mp4 [ 36.84MB ]
｜ ｜ ｜ ｜ 9.6 复位信号.mp4 [ 10.84MB ]
｜ ｜ ｜ ｜ 9.7 时钟复位代码实现.mp4 [ 60.45MB ]
｜ ｜ ｜ ｜ 9.8 任务：了解PLL IP.html [ 582B ]
｜ ｜ ｜ ｜ 9.9 任务：了解pin mux的实现.html [ 938B ]
｜ ｜ ｜ 第09章 软硬件协同验证 [ 219.63MB ]
｜ ｜ ｜ ｜ 10.1 系统启动.mp4 [ 24.48MB ]
｜ ｜ ｜ ｜ 10.2 testbench结构.mp4 [ 18.56MB ]
｜ ｜ ｜ ｜ 10.3 验证环境代码.mp4 [ 42.90MB ]
｜ ｜ ｜ ｜ 10.4 C编译工具及环境建立.mp4 [ 25.23MB ]
｜ ｜ ｜ ｜ 10.5 tarmc使用.mp4 [ 23.06MB ]
｜ ｜ ｜ ｜ 10.6 testcase.mp4 [ 36.40MB ]
｜ ｜ ｜ ｜ 10.7 任务：系统启动.html [ 739B ]
｜ ｜ ｜ ｜ 10.8 DMA Case讲解.mp4 [ 49.00MB ]
｜ ｜ ｜ 第10章 背景知识 [ 41.32MB ]
｜ ｜ ｜ ｜ 11.1 章节说明.html [ 471B ]
｜ ｜ ｜ ｜ 11.2 什么是测试.mp4 [ 13.82MB ]
｜ ｜ ｜ ｜ 11.3 缺陷 故障和失效.mp4 [ 15.37MB ]
｜ ｜ ｜ ｜ 11.4 基本扫描单元.mp4 [ 3.60MB ]
｜ ｜ ｜ ｜ 11.5 扫描链.mp4 [ 8.52MB ]
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